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參數(shù)資料
| 型號(hào)： | XRT72L50 |
| 廠商： | EXAR CORP |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | DATACOM, FRAMER, PQFP100 |
| 封裝： | 14 X 20 MM, PLASTIC, QFP-100 |
| 文件頁(yè)數(shù)： | 141/475頁(yè) |
| 文件大?。?/td> | 5760K |
| 代理商： | XRT72L50 |
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á
PRELIMINARY
SINGLE CHANNEL DS3/E3 FRAMER IC WITH HDLC CONTROLLER
XRT72L50
REV. P1.1.3
122
General Flow of Framer Chip Interrupt Servicing
When any of the conditions, presented in Table 5 oc-
curs, (if their Interrupts is enabled), then the Framer
will generate an interrupt request to the local μP/μC
by asserting the active-low interrupt request output
pin, INT. Shortly after the local μP/μC has detected
the activated INT signal, it will enter into the appropri-
ate user-supplied interrupt service routine. The first
task for the local μP/μC, while running this interrupt
service routine, may be to isolate the source of the in-
terrupt request down to the device level (e.g., the
XRT72L50 Framer Device), if multiple peripheral de-
vices exist in the user's system. However, once the
interrupting peripheral device has been identified, the
next task for the local μP/μC is to determine exactly
what feature or functional section within the device re-
quested the interrupt.
Determine the Channel Requesting the Interrupt
If the “interrupting” device turns out to be the
XRT72L50 3-Channel DS3/E3 Framer IC;
Determine the Functional Block(s) Requesting the
Interrupt
If the interrupt device turns out to be the XRT72L50
DS3/E3 Framer IC, then the local μC/μP must deter-
mine which functional block requested the interrupt.
Hence, upon reaching this state, one of the very first
things that the local μC/μP must do within the user
supplied Framer Interrupt Service routine, is to per-
form a read of the Block Interrupt Status Register
(Address = 0x05) within the XRT72L50 Framer de-
vice. The bit format of the Block Interrupt Status reg-
ister is presented below.
The Block Interrupt Status Register presents the in-
terrupt request status of each functional block, within
the chip. The purpose of the Block Interrupt Status
Register is to help the local μP/μC identify which func-
tional block(s) has requested the interrupt. Whichev-
er bit(s) are asserted in this register, identifies which
block(s) have experienced an interrupt-generating
condition as presented in Table 5. Once the local μP/
μC has read this register, it can determine which
branch within the interrupt service routine that it must
follow, in order to properly service this interrupt.
The Framer further supports the Functional Block hi-
erarchy by providing the Block Interrupt Enable Reg-
ister (Address = 0x04). The bit format of this register
is identical to that for the Block Interrupt Status regis-
T
ABLE
8: A L
ISTING
OF
THE
XRT72L50 F
RAMER
D
EVICE
I
NTERRUPT
B
LOCK
R
EGISTER
(
FOR
E3, ITU-T G.751
A
PPLICATIONS
)
A
DDRESS
L
OCATION
R
EGISTER
N
AME
0 x 04
Block Interrupt Enable Register
0 x 05
Block Interrupt Status Register
0 x 12
RxE3 Interrupt Enable Register -1
0 x 13
RxE3 Interrupt Enable Register -2
0 x 14
RxE3 Interrupt Status Register - 1
0 x 15
RxE3 Interrupt Status Register - 2
0 x 18
RxE3 LAPD Control Register
0 x 34
TxE3 LAPD Status/Interrupt Status
BLOCK INTERRUPT STATUS REGISTER (ADDRESS = 0X05)
B
IT
7
B
IT
6
B
IT
5
B
IT
4
B
IT
3
B
IT
2
B
IT
1
B
IT
0
RxDS3/E3
Interrupt
Status
Not Used
TxDS3/E3
Interrupt
Status
One-Second
Interrupt
Status
RO
RO
RO
RO
RO
RO
RO
RO
0
0
0
0
0
0
0
0
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