GD3 (V/V)" />
參數(shù)資料
型號： XE8801AMI027LF
廠商： Semtech
文件頁數(shù)： 131/135頁
文件大?。?/td> 0K
描述： IC DAS 16BIT FLASH 8K MTP 44LQFP
標(biāo)準(zhǔn)包裝： 800
系列： XE880x
應(yīng)用： 感測機(jī)
核心處理器： Coolrisc816?
程序存儲(chǔ)器類型： 閃存（22 kB）
控制器系列： XE8000
RAM 容量： 512 x 8
接口： UART，USRT
輸入/輸出數(shù)： 24
電源電壓： 2.4 V ~ 5.5 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 44-VFQFN 裸露焊盤
包裝： 托盤
供應(yīng)商設(shè)備封裝： 44-MLPQ（7x7）
產(chǎn)品目錄頁面： 585 (CN2011-ZH PDF)
配用： XE8000MP-ND - PROG BOARD AND PROSTART2 CARD
Semtech 2005
www.semtech.com
16-10
XE8801A – SX8801R
PGA3_GAIN[6:0]
PGA3 Gain
GD3 (V/V)
0000000
0
0000001
1/12(=0.083)
...
0000110
6/12
...
0001100
12/12
0010000
16/12
...
0100000
32/12
...
1000000
64/12
...
1111111
127/12(=10.58)
Table 16-17 PGA3 gain settings
PGA3_OFFSET[6:0]
PGA3 Offset
GDoff3 (V/V)
0000000
0
0000001
+1/12(=+0.083)
0000010
+2/12
...
0010000
+16/12
...
0100000
+32/12
...
0111111
+63/12(=+5.25)
1000000
0
1000001
-1/12(=-0.083)
1000010
-2/12
...
1010000
-16/12
...
1100000
-32/12
...
1111111
-63/12(=-5.25)
Table 16-18 PGA3 offset settings
16.6.1
PGA & ADC Enabling
Depending on the application objectives, the user may enable or bypass each PGA stage. This is done according to
the word ENABLE and the coding given in Table 16-13. To reduce power dissipation, the ADC can also be inactivated
while idle.
16.6.2
PGA1
The first stage can have a buffer function (unity gain) or provide a gain of 10 (see Table 16-14). The voltage VD1 at
the output of PGA1 is:
IN
D
V
GD
V
=
1
(V)
(Eq. 5)
where GD1 is the gain of PGA1 (in V/V) controlled with the bit PGA1_GAIN.
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