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參數(shù)資料
| 型號： | XE8801AMI027LF |
| 廠商： | Semtech |
| 文件頁數(shù)： | 127/135頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC DAS 16BIT FLASH 8K MTP 44LQFP |
| 標(biāo)準(zhǔn)包裝： | 800 |
| 系列： | XE880x |
| 應(yīng)用： | 感測機(jī) |
| 核心處理器： | Coolrisc816? |
| 程序存儲器類型： | 閃存（22 kB） |
| 控制器系列： | XE8000 |
| RAM 容量： | 512 x 8 |
| 接口： | UART，USRT |
| 輸入/輸出數(shù)： | 24 |
| 電源電壓： | 2.4 V ~ 5.5 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 44-VFQFN 裸露焊盤 |
| 包裝： | 托盤 |
| 供應(yīng)商設(shè)備封裝： | 44-MLPQ（7x7） |
| 產(chǎn)品目錄頁面： | 585 (CN2011-ZH PDF) |
| 配用： | XE8000MP-ND - PROG BOARD AND PROSTART2 CARD |
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Semtech 2005
www.semtech.com
16-6
XE8801A – SX8801R
16.4.2
Peripheral Registers
Figure 16-2 shows a detailed functional diagram of the ZoomingADC
. In
Table 16-10 the configuration of the peripheral registers is detailed. The system has a bank of eight 8-bit registers:
six registers are used to configure the acquisition chain (RegAcCfg0 to 5), and two registers are used to store the
output code of the analog-to-digital conversion (RegAcOutMsb & Lsb). The register coding of the ADC parameters
and performance characteristics are detailed in Section 16.7.
Table 16-10. Peripheral registers to configure the acquisition chain (AC)
and to store the analog-to-digital conversion (ADC) result
Bit Position
Register
Name
7
6
5
4
3
2
1
0
RegAcOutLsb
OUT[7:0]
RegAcOutMsb
OUT[15:8]
RegAcCfg0
Default
values:
STAR
T
0
SET_NELC[1:0]
01
SET_OSR[2:0]
010
CONT
0
TEST
0
RegAcCfg1
Default
values:
IB_AMP_ADC[
1:0]
11
IB_AMP_PGA[1:
0]
11
ENABLE[3:0]
0001
RegAcCfg2
Default
values:
FIN[1:0]
00
PGA2_GAIN[1:0]
00
PGA2_OFFSET[3:0]
0000
RegAcCfg3
Default
values:
PGA1
_G
0
PGA3_GAIN[6:0]
0000000
RegAcCfg4
Default
values:
0
PGA3_OFFSET[6:0]
0000000
RegAcCfg5
Default
values:
BUSY
0
DEF
0
AMUX[4:0]
00000
VMUX
0
With:
OUT
: (r) digital output code of the analog-to-digital converter. (MSB = OUT[15])
START
: (w) setting this bit triggers a single conversion (after the current one is finished). This bit always reads
back 0.
SET_NELC
: (rw) sets the number of elementary conversions to 2
SET_NELC[1:0] . To compensate for offsets, the
input signal is chopped between elementary conversions (1,2,4,8).
SET_OSR
: (rw) sets the over-sampling rate (OSR) of an elementary conversion to 2
(3+SET_OSR[2:0]) . OSR = 8, 16,
32, ..., 512, 1024.
CONT
: (rw) setting this bit starts a conversion. A new conversion will automatically begin as long as the bit
remains at 1.
TEST
: bit only used for test purposes. In normal mode, this bit is forced to 0 and cannot be overwritten.
IB_AMP_ADC
: (rw) sets the bias current in the ADC to 0.25*(1+ IB_AMP_ADC[1:0]) of the normal operation
current (25, 50, 75 or 100% of nominal current). To be used for low-power, low-speed operation.
IB_AMP_PGA
: (rw) sets the bias current in the PGAs to 0.25*(1+IB_AMP_PGA[1:0]) of the normal operation
current (25, 50, 75 or 100% of nominal current). To be used for low-power, low-speed operation.
ENABLE
: (rw) enables the ADC modulator (bit 0) and the different stages of the PGAs (PGAi by bit i=1,2,3). PGA stages that
are disabled are bypassed.
FIN
: (rw) These bits set the sampling frequency of the acquisition chain. Expressed as a fraction of the oscillator frequency,
the sampling frequency is given as: 00
1/4 fRC, 01
1/8 fRC, 10
1/32 fRC, 11
~8kHz.
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