參數(shù)資料
型號： XC3S400-4FG320I
廠商： Xilinx Inc
文件頁數(shù)： 268/272頁
文件大?。?/td> 0K
描述： IC SPARTAN-3 FPGA 400K 320-FBGA
標(biāo)準(zhǔn)包裝： 84
系列： Spartan®-3
LAB/CLB數(shù)： 896
邏輯元件/單元數(shù)： 8064
RAM 位總計： 294912
輸入/輸出數(shù)： 221
門數(shù)： 400000
電源電壓： 1.14 V ~ 1.26 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 100°C
封裝/外殼： 320-BGA
供應(yīng)商設(shè)備封裝： 320-FBGA（19x19）
其它名稱： Q3365683
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁第205頁第206頁第207頁第208頁第209頁第210頁第211頁第212頁第213頁第214頁第215頁第216頁第217頁第218頁第219頁第220頁第221頁第222頁第223頁第224頁第225頁第226頁第227頁第228頁第229頁第230頁第231頁第232頁第233頁第234頁第235頁第236頁第237頁第238頁第239頁第240頁第241頁第242頁第243頁第244頁第245頁第246頁第247頁第248頁第249頁第250頁第251頁第252頁第253頁第254頁第255頁第256頁第257頁第258頁第259頁第260頁第261頁第262頁第263頁第264頁第265頁第266頁第267頁當(dāng)前第268頁第269頁第270頁第271頁第272頁
Spartan-3 FPGA Family: DC and Switching Characteristics
DS099 (v3.1) June 27, 2013
Product Specification
95
Digital Frequency Synthesizer (DFS)
Lock Time
LOCK_DLL
When using the DLL alone:
The time from deassertion at
the DCM’s Reset input to the
rising transition at its
LOCKED output. When the
DCM is locked, the CLKIN and
CLKFB signals are in phase
18 MHz
≤ FCLKIN ≤ 30 MHz
All
–
2.88
–
2.88
ms
30 MHz
< FCLKIN ≤ 40 MHz
–
2.16
–
2.16
ms
40 MHz
< FCLKIN ≤ 50 MHz
–
1.20
–
1.20
ms
50 MHz
< FCLKIN ≤ 60 MHz
–
0.60
–
0.60
ms
FCLKIN > 60 MHz
–
0.48
–
0.48
ms
Delay Lines
DCM_TAP
Delay tap resolution
All
30.0
60.0
30.0
60.0
ps
Notes:
1.
The numbers in this table are based on the operating conditions set forth in Table 32 and Table 58.
2.
DLL specifications apply when any of the DLL outputs (CLK0, CLK90, CLK180, CLK270, CLK2X, CLK2X180, or CLKDV) are in use.
3.
Only mask revision ‘E’ and later devices (see Mask and Fab Revisions, page 58) and all revisions of the XC3S50 and the XC3S1000 support
DLL feedback using the CLK2X output. For all other Spartan-3 devices, use feedback from the CLK0 output (instead of the CLK2X output)
and set the CLK_FEEDBACK attribute to 1X.
4.
Indicates the maximum amount of output jitter that the DCM adds to the jitter on the CLKIN input.
5.
This specification only applies if the attribute DUTY_CYCLE_CORRECTION = TRUE.
Table 60: Recommended Operating Conditions for the DFS
Symbol
Description
Frequency
Mode
Speed Grade
Units
-5
-4
MinMax
Input Frequency Ranges(2)
FCLKIN
CLKIN_FREQ_FX
Frequency for the CLKIN input
All
1
280
1
280
MHz
Input Clock Jitter Tolerance(3)
CLKIN_CYC_JITT_FX_LF
Cycle-to-cycle jitter at the CLKIN
input
Low
–
±300
–
±300
ps
CLKIN_CYC_JITT_FX_HF
High
–
±150
–
±150
ps
CLKIN_PER_JITT_FX
Period jitter at the CLKIN input
All
–
±1
–
±1ns
Notes:
1.
DFS specifications apply when either of the DFS outputs (CLKFX or CLKFX180) are used.
2.
If both DFS and DLL outputs are used on the same DCM, follow the more restrictive CLKIN_FREQ_DLL specifications in Table 58.
3.
CLKIN input jitter beyond these limits may cause the DCM to lose lock.
Table 59: Switching Characteristics for the DLL (Cont’d)
Symbol
Description
Frequency Mode /
FCLKIN Range
Device
Speed Grade
Units
-5
-4
Min
Max
Min
Max
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PDF描述
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