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參數(shù)資料
| 型號： | XC3S400-4FG320I |
| 廠商： | Xilinx Inc |
| 文件頁數(shù)： | 209/272頁 |
| 文件大小： | 0K |
| 描述： | IC SPARTAN-3 FPGA 400K 320-FBGA |
| 標(biāo)準(zhǔn)包裝： | 84 |
| 系列： | Spartan®-3 |
| LAB/CLB數(shù)： | 896 |
| 邏輯元件/單元數(shù)： | 8064 |
| RAM 位總計(jì)： | 294912 |
| 輸入/輸出數(shù)： | 221 |
| 門數(shù)： | 400000 |
| 電源電壓： | 1.14 V ~ 1.26 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | -40°C ~ 100°C |
| 封裝/外殼： | 320-BGA |
| 供應(yīng)商設(shè)備封裝： | 320-FBGA（19x19） |
| 其它名稱： | Q3365683 |
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Spartan-3 FPGA Family: Functional Description
DS099 (v3.1) June 27, 2013
Product Specification
41
The Status Logic Component
The Status Logic component not only reports on the state of the DCM but also provides a means of resetting the DCM to an
initial known state. The signals associated with the Status Logic component are described in Table 22.
As a rule, the Reset (RST) input is asserted only upon configuring the device or changing the CLKIN frequency. A DCM reset
does not affect attribute values (e.g., CLKFX_MULTIPLY and CLKFX_DIVIDE). If not used, RST must be tied to GND.
The eight bits of the STATUS bus are defined in Table 23.
X-Ref Target - Figure 23
Figure 23: Phase Shifter Waveforms
DS099-2_11_031303
CLKIN
CLKFB
* TCLKIN
P
256
b. CLKOUT_PHASE_SHIFT = FIXED
* TCLKIN
P
256
Shift Range over all P Values:
–255
+255
Shift Range over all P Values:
0
–255
+255
Shift Range over all N Values:
0
–255
+255
CLKIN
CLKFB before
Decrement
c. CLKOUT_PHASE_SHIFT = VARIABLE
CLKFB after
Decrement
* TCLKIN
N
256
CLKIN
CLKFB
a. CLKOUT_PHASE_SHIFT = NONE
Notes:
1.
P represents the integer value ranging from –255 to +255 to which the PHASE_SHIFT attribute is assigned.
2.
N is an integer value ranging from –255 to +255 that represents the net phase shift effect from a series of increment
and/or decrement operations.
N = {Total number of increments} – {Total number of decrements}
A positive value for N indicates a net increment; a negative value indicates a net decrement.
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