參數(shù)資料
型號： XC3S1600E-5FGG484C
廠商： Xilinx Inc
文件頁數(shù)： 106/227頁
文件大?。?/td> 0K
描述： IC FPGA SPARTAN-3E 1600K 484FBGA
標準包裝： 60
系列： Spartan®-3E
LAB/CLB數(shù)： 3688
邏輯元件/單元數(shù)： 33192
RAM 位總計： 663552
輸入/輸出數(shù)： 376
門數(shù)： 1600000
電源電壓： 1.14 V ~ 1.26 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 484-BBGA
供應商設備封裝： 484-FBGA
配用： HW-XA3S1600E-UNI-G-ND - KIT DEVELOPMENT AUTOMOTIVE ECU
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Spartan-3E FPGA Family: Pinout Descriptions
DS312 (v4.1) July 19, 2013
Product Specification
194
User I/Os by Bank
Table 144, Table 145, and Table 146 indicate how the
available user-I/O pins are distributed between the four I/O
banks on the FT256 package.
The XC3S250E FPGA in the FT256 package has 18
unconnected balls, labeled with an “N.C.” type. These pins
are also indicated with the black diamond (
) symbol in
.
Table 144: User I/Os Per Bank on XC3S250E in the FT256 Package
Package
Edge
I/O Bank
Maximum I/O
All Possible I/O Pins by Type
I/O
INPUT
DUAL
Top
0
44
20
10
1
5
8
Right
1
42
10
7
21
4
Bottom
2
44
8
9
24
3
Left
3
42
24
7
0
3
8
TOTAL
172
62
33
46
15
16
Notes:
1.
Some VREF and CLK pins are on INPUT pins.
2.
The eight global clock pins in this bank have optional functionality during configuration and are counted in the DUAL column.
Table 145: User I/Os Per Bank on XC3S500E in the FT256 Package
Package
Edge
I/O Bank
Maximum I/O
All Possible I/O Pins by Type
I/O
INPUT
DUAL
VREF(1)
Top
0
46
22
10
1
5
8
Right
1
48
15
7
21
5
Bottom
2
48
11
9
24
4
Left
3
48
28
7
0
5
8
TOTAL
190
76
33
46
19
16
Notes:
1.
Some VREF and CLK pins are on INPUT pins.
2.
The eight global clock pins in this bank have optional functionality during configuration and are counted in the DUAL column.
Table 146: User I/Os Per Bank on XC3S1200E in the FT256 Package
Package
Edge
I/O Bank
Maximum I/O
All Possible I/O Pins by Type
I/O
INPUT
DUAL
VREF(1)
Top
0
46
24
8
1
5
8
Right
1
48
14
8
21
5
Bottom
2
48
13
7
24
4
Left
3
48
27
8
0
5
8
TOTAL
190
78
31
46
19
16
Notes:
1.
Some VREF and CLK pins are on INPUT pins.
2.
The eight global clock pins in this bank have optional functionality during configuration and are counted in the DUAL column.
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PDF描述
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