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參數(shù)資料
| 型號： | XC3030L-8VQ100I |
| 廠商： | XILINX INC |
| 元件分類： | FPGA |
| 英文描述： | Field Programmable Gate Arrays (XC3000A/L, XC3100A/L) |
| 中文描述： | FPGA, 100 CLBS, 1500 GATES, 80 MHz, PQFP100 |
| 封裝： | PLASTIC, VQFP-100 |
| 文件頁數(shù)： | 66/76頁 |
| 文件大?。?/td> | 731K |
| 代理商： | XC3030L-8VQ100I |
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R
XC3000 Series Field Programmable Gate Arrays
7-68
November 9, 1998 (Version 3.1)
XC3064A/XC3090A/XC3195A 84-Pin PLCC Pinouts
XC3000A, XC3000L, XC3100A, and XC3100L families have identical pinouts
Unprogrammed IOBs have a default pull-up. This prevents an undefined pad level for unbonded or unused IOBs.
Programmed outputs are default slew-rate limited.
* In the PC84 package, XC3064A, XC3090A and XC3195A have additional VCC and GND pins and thus a different pin
definition than XC3020A/XC3030A/XC3042A.
PLCC Pin Number
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XC3064A, XC3090A, XC3195A
PWRDN
TCLKIN-I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
GND*
VCC
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
M1-RDATA
M0-RTRIG
M2-I/O
HDC-I/O
I/O
LDC-I/O
I/O
I/O
I/O
I/O
INIT/I/O*
VCC*
GND
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
XTL2(IN)-I/O
PLCC Pin Number
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11
XC3064A, XC3090A, XC3195A
RESET
DONE-PG
D7-I/O
XTL1(OUT)-BCLKIN-I/O
D6-I/O
I/O
D5-I/O
CS0-I/O
D4-I/O
I/O
VCC
GND*
D3-I/O*
CS1-I/O*
D2-I/O*
I/O
D1-I/O
RDY/BUSY-RCLK-I/O
D0-DIN-I/O
DOUT-I/O
CCLK
A0-WS-I/O
A1-CS2-I/O
A2-I/O
A3-I/O
I/O
I/O
A15-I/O
A4-I/O
A14-I/O
A5-I/O
GND
VCC*
A13-I/O*
A6-I/O*
A12-I/O*
A7-I/O*
I/O
A11-I/O
A8-I/O
A10-I/O
A9-I/O
相關PDF資料 |
PDF描述 |
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相關代理商/技術參數(shù) |
參數(shù)描述 |
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| XC3042 | 制造商:Xilinx 功能描述: |
| XC3042-100CB100B | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field Programmable Gate Array (FPGA) |
| XC3042-100CB100C | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field Programmable Gate Array (FPGA) |
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