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參數(shù)資料
| 型號： | X4C105 |
| 元件分類： | CPU監(jiān)測 |
| 英文描述： | RTC Module With CPU Supervisor |
| 中文描述： | 時鐘模塊CPU監(jiān)控 |
| 文件頁數(shù)： | 12/18頁 |
| 文件大?。?/td> | 93K |
| 代理商： | X4C105 |
X4C105
12
SERIAL MEMORY AC CHARACTERISTICS
Serial AC Test Conditions
Equivalent AC Output Load Circuit for V
CC
= 3.0-3.6V
Input Pulse Levels
V
CC
x 0.1 to V
CC
x 0.9
Input Rise and Fall
Times
Input and Output
Timing Levels
Output Load
10ns
V
CC
x 0.5
Standard Output Load
SDA
1533
W
100pF
3.3V
For V
OL
= 0.4V
and I
OL
= 2mA
SERIAL AC SPECIFICATIONS
T
A
= -40C to +85C, V
CC
= +3.0V to +3.6V, unless otherwise specified
.
Notes:
1.
2.
This parameter is periodically sampled and not 100% tested.
Cb = total capacitance of one bus line in pF.
Symbol
f
SCL
t
IN
t
AA
t
BUF
t
LOW
t
HIGH
t
SU:STA
t
HD:STA
t
SU:DAT
t
HD:DAT
t
SU:STO
t
DH
t
R
t
F
t
SU: S1,
S2,WP
t
HD: S1,
S2,WP
Cb
Parameter
400kHz Option
Min.
Units
Max.
SCL Clock Frequency
0
400
KHz
Pulse width of spikes to be suppressed by the input filter
0
50
nS
SCL LOW to SDA Data Out Valid
0.1
0.9
m
S
Time the bus must be free before a new transmission can start
1.3
m
S
Clock LOW Time
1.3
m
S
Clock HIGH Time
0.6
m
S
Start Condition Setup Time
0.6
m
S
Start Condition Hold Time
0.6
m
S
Data In Setup Time
100
nS
Data In Hold Time
0
m
S
Stop Condition Setup Time
0.6
m
S
Data Output Hold Time
50
nS
SDA and SCL Rise Time
20 +.1Cb
(2)
300
nS
SDA and SCL Fall Time
20 +.1Cb
(2)
300
nS
S1, S2, and WP Setup Time
0.4
mS
S1, S2, and WP Hold Time
0.4
mS
Capacitive load for each bus line
400
pF
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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