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參數(shù)資料
| 型號： | VL6524 |
| 廠商： | 意法半導(dǎo)體 |
| 英文描述： | VGA single-chip camera module |
| 中文描述： | 顯卡單芯片相機(jī)模塊 |
| 文件頁數(shù)： | 61/70頁 |
| 文件大?。?/td> | 505K |
| 代理商： | VL6524 |
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VL6524/VS6524
Electrical characteristics
61/70
Figure 32.
Voltage level specification
Table 38.
Timing specification
(1)
1.
All values are referred to a V
IHmin
= 0.9 V
DD
and V
ILmax
= 0.1 V
DD
C
b
= capacitance of one bus line in pF
Symbol
Parameter
Standard mode
Fast mode
Unit
Min.
Max.
Min.
Max.
f
SCL
t
HD;STA
SCL clock frequency
0
100
0
400
kHz
Hold time for a repeated
start
4.0
-
0.6
-
μ
s
t
LOW
LOW period of SCL
4.7
-
1.3
-
μ
s
t
HIGH
t
SU;STA
HIGH period of SCL
4.0
-
0.6
-
μ
s
Set-up time for a repeated
start
4.7
-
0.6
-
μ
s
t
HD;DAT
Data hold time (1)
300
-
300
-
ns
t
SU;DAT
t
r
Data Set-up time (1)
250
-
100
-
ns
Rise time of SCL, SDA
-
1000
20+0.1C
b(2)
20+0.1C
b(2)
2.
300
ns
t
f
Fall time of SCL, SDA
-
300
300
ns
t
SU;STO
Set-up time for a
stop
4.0
-
0.6
-
μ
s
t
BUF
Bus free time between a
stop
and
a
start
4.7
-
1.3
-
μ
s
C
b
Capacitive Load for each bus line
-
400
-
400
pF
V
nL
Noise Margin at the LOW level for
each connected device (including
hysteresis)
0.1 V
DD
-
0.1 V
DD
-
V
V
nH
Noise Margin at the HIGH level for
each connected device (including
hysteresis)
0.2 V
DD
-
0.2 V
DD
-
V
V
OH
= 0.8 * V
DD
V
OL
= 0.2 * V
DD
Input voltage levels
Output voltage levels
V
IH
V
IL
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| VL68C45R-35PC | Non-VGA Video Controller |
| VL68C45R-35QC | Non-VGA Video Controller |
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| VL68C45S-23PC | Non-VGA Video Controller |
| VL68C45S-23QC | Non-VGA Video Controller |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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