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參數(shù)資料
| 型號： | UPD78F9510GR-JJG-A |
| 廠商： | Renesas Electronics America |
| 文件頁數(shù)： | 158/175頁 |
| 文件大?。?/td> | 0K |
| 描述： | MCU 8BIT SGL CHIP 16PIN |
| 標(biāo)準(zhǔn)包裝： | 400 |
| 系列： | 78K0S/Kx1+ |
| 核心處理器： | 78K0S |
| 芯體尺寸： | 8-位 |
| 速度： | 10MHz |
| 外圍設(shè)備： | LVD，POR，PWM，WDT |
| 輸入/輸出數(shù)： | 13 |
| 程序存儲(chǔ)器容量： | 1KB（1K x 8） |
| 程序存儲(chǔ)器類型： | 閃存 |
| RAM 容量： | 128 x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 2 V ~ 5.5 V |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 16-SSOP（0.173"，4.40mm 寬） |
| 包裝： | 托盤 |
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CHAPTER 5 CLOCK GENERATORS
User’s Manual U16994EJ6V0UD
81
Figure 5-7. Examples of Incorrect Resonator Connection (2/2)
(e) Signals are fetched
VSS
X1
X2
5.4.3
External clock input circuit
This circuit supplies a clock from an external IC to the X1 pin.
If external clock input is selected by the option byte as the system clock source, the X2 pin can be used as an I/O
port pin.
For details of the option byte, refer to CHAPTER 15 OPTION BYTE. For details of I/O ports, refer to CHAPTER 4
PORT FUNCTIONS.
5.4.4
Prescaler
The prescaler divides the clock (fX) output by the system clock oscillator to generate a clock (fXP) to be supplied to
the peripheral hardware. It also divides the clock to peripheral hardware (fXP) to generate a clock to be supplied to the
CPU.
Remark
The clock output by the oscillator selected by the option byte (high-speed internal oscillator,
crystal/ceramic oscillator, or external clock input circuit) is divided. For details of the option byte, refer to
CHAPTER 15 OPTION BYTE.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| UPD78F9210GR-JJG-A | MCU 8BIT 1KB FLASH MEM 16-SSOP |
| P87LPC760BDH,118 | IC 80C51 MCU 1KB OTP 14TSSOP |
| MC74HCT4851ADTG | ANALOG MULTIPLEXERS/DEMUL TSSOP |
| MC74HCT4851ADG | ANALOG MULTIPLEXERS/DEMUL SOIC16 |
| MC74HC4851ADG | IC MUX/DEMUX 8X1 16SOIC |
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參數(shù)描述 |
|---|---|
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| UPD78F9801GB-8ES-A | 制造商:Renesas Electronics Corporation 功能描述: |
| UPD78F9842GB-8ES | 制造商:Renesas Electronics Corporation 功能描述: |
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