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參數(shù)資料
| 型號(hào)： | UPD75238GJ |
| 廠商： | NEC Corp. |
| 英文描述： | 4 BIT SINGLE-CHIP MICROCOMPUTER |
| 中文描述： | 4位單片機(jī) |
| 文件頁(yè)數(shù)： | 84/190頁(yè) |
| 文件大?。?/td> | 1702K |
| 代理商： | UPD75238GJ |
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84
μ
PD75238
Fig. 4-40 Format of Serial Operation Mode Register 0 (CSIM0) (3/3)
Signal from address comparator (R)
Note
COI can be read only before serial transfer is started or after serial transfer is completed. An
undefined value may be read during transfer.
COI data written by an 8-bit manipulation instruction is ignored.
Serial interface operation enable/disable specification bit (W)
Remarks 1.
Each mode can be selected by setting CSIE0, CSIM03, and CSIM02.
2.
The P01/SCK0 pin assumes the following state according to the setting of CSIE0, CSIM01, and
CSIM00:
Condition for being set (COI = 1)
When the slave address register (SVA) matches the
data of the shift register
Condition for being cleared (COI = 0)
When the slave address register (SVA) does not match
the data of the shift register
0
1
Serial clock counter
Cleared
Count operation
IRQCSI0 flag
Held
Can be set.
SO0/SB0, SI0/SB1 pin
Used only for port 0
Used in each mode as
well as for port 0
CSIE0
Shift register 0 operation
Shift operation disabled
Shift operation enabled
CSIE0
0
1
1
1
CSIM03
×
0
1
1
CSIM02
×
×
0
1
Operation mode
Operation halt mode
Three-wire serial I/O mode
SBI mode
Two-wire serial I/O mode
CSIE0
0
1
0
0
0
1
1
1
CSIM01
0
0
0
1
1
0
1
1
CSIM00
0
0
1
0
1
1
0
1
P01/SCK0 pin state
Input port
High impedance
High level output
Serial clock output (High level output)
COI
Note
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