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參數(shù)資料
| 型號： | TSS461C-TDRZ |
| 廠商： | ATMEL CORP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | VAN Data Link Controller |
| 中文描述： | 1 CHANNEL(S), 1M bps, LOCAL AREA NETWORK CONTROLLER, PDSO24 |
| 封裝： | ROHS COMPLIANT, SO-24 |
| 文件頁數(shù)： | 24/57頁 |
| 文件大小： | 423K |
| 代理商： | TSS461C-TDRZ |
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24
TSS461C
4193G–AUTO–12/04
Control and Status
Registers
Line Control Register (0x00)
Read/write register.
Default value after reset: 0y00
reserved: Bit 2, this bit cannot be set by the user; a 0 must always be written to this
bit.
CD[3:0] Clock Divider
They control the VAN Bus rate through a Baud Rate generator according to the follow-
ing formula:
PC Pulsed CodeOne
The TSS461C will transmit and receive data using the pulsed coding mode (i.e optical
or radio link mode). The use of this mode implies communication via the RXD0 input
and the non-functionality of the diagnosis system.
Zero: (Default at Reset). The TSS461C will transmit and receive data using the
Enhanced Manchester code (RXD0, RXD1, RXD2).
IVTX
Invert TXD output.
IVRX
Invert RXD inputs.The user can invert the logical levels used on either the TXD output or
the RXD inputs in order to adapt to different line drivers and receivers.
One: A one on either of these bits will invert the respective signals.
Zero: (Default at Reset). The TSS461C will set TXD to recessive state in Idle mode and
consider the bus free (recessive states on RXD inputs).
Transmit Control Register
(0x01)
Read/Write register
Default value after reset: 0x02
7
6
5
4
3
2
1
0
MR3
MR2
MR1
MR0
VER2
VER1
VER0
MT
F
TSCLK
F
1
n
×
16
------------------
=
7
6
5
4
3
2
1
0
MR3
MR2
MR1
MR0
VER2
VER1
VER0
MT
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| TSS461CD | LAN Node Controller |
| TSS461CR | LAN Node Controller |
| TSS463-AA | TSS463-AA [Updated 3/03. 60 Pages] |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| TSS461E-TDRZ-9 | 制造商:ATMEL 制造商全稱:ATMEL Corporation 功能描述:VAN Data Link Controller |
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