參數(shù)資料
型號： TMS320WP010PZA
英文描述： Cell-Phone Circuit
中文描述： 手機電路
文件頁數(shù)： 93/132頁
文件大?。?/td> 1707K
代理商： TMS320WP010PZA
.
.
.
S
–
–
P
–
1
9
SPI MASTER MODE TIMING PARAMETERS
SPI master mode timing information is listed in the following tables.
SPI master mode external timing parameters (clock phase = 0)
(see Figure 40)
NO.
SPI WHEN (SPIBRR + 1) IS EVEN
OR SPIBRR = 0 OR 2
SPI WHEN (SPIBRR + 1)
IS ODD AND SPIBRR > 3
UNIT
MIN
MAX
MIN
MAX
1
tc(SPC)M
Cycle time, SPICLK
4tc(CO)
128tc(CO)
5tc(CO)
127tc(CO)
ns
2
§
tw(SPCH)M
Pulse duration, SPICLK high
(clock polarity = 0)
0.5tc(SPC)M
–
10
0.5tc(SPC)M
0.5tc(SPC)M
–
0.5tc(CO)
–
10
0.5tc(SPC)M
–
0.5tc(CO)
ns
tw(SPCL)M
Pulse duration, SPICLK low
(clock polarity = 1)
0.5tc(SPC)M
–
10
0.5tc(SPC)M
0.5tc(SPC)M
–
0.5tc(CO)
–
10
0.5tc(SPC)M
–
0.5tc(CO)
3
§
tw(SPCL)M
Pulse duration, SPICLK low
(clock polarity = 0)
0.5tc(SPC)M
–
10
0.5tc(SPC)M
0.5tc(SPC)M+0.5tc(CO)
–
10
0.5tc(SPC)M + 0.5tc(CO)
ns
tw(SPCH)M
Pulse duration, SPICLK high
(clock polarity = 1)
0.5tc(SPC)M
–
10
0.5tc(SPC)M
0.5tc(SPC)M+0.5tc(CO)
–
10
0.5tc(SPC)M + 0.5tc(CO)
4
§
td(SPCH-SIMO)M
Delay time, SPICLK high to
SPISIMO valid (clock polarity = 0)
–
10
10
–
10
10
ns
td(SPCL-SIMO)M
Delay time, SPICLK low to
SPISIMO valid (clock polarity = 1)
–
10
10
–
10
10
5
§
tv(SPCL-SIMO)M
Valid time, SPISIMO data valid after
SPICLK low (clock polarity =0)
0.5tc(SPC)M
–
10
0.5tc(SPC)M+0.5tc(CO)
–
10
ns
tv(SPCH-SIMO)M
Valid time, SPISIMO data valid after
SPICLK high (clock polarity =1)
0.5tc(SPC)M
–
10
0.5tc(SPC)M+0.5tc(CO)
–
10
8
§
tsu(SOMI-SPCL)M
Setup time, SPISOMI before
SPICLK low (clock polarity = 0)
0
0
ns
tsu(SOMI-SPCH)M
Setup time, SPISOMI before
SPICLK high (clock polarity = 1)
0
0
9
§
tv(SPCL-SOMI)M
Valid time, SPISOMI data valid after
SPICLK low (clock polarity = 0)
0.25tc(SPC)M
–
10
0.5tc(SPC)M
–
0.5tc(CO)
–
10
ns
tv(SPCH-SOMI)M
Valid time, SPISOMI data valid after
SPICLK high (clock polarity = 1)
0.25tc(SPC)M
–
10
0.5tc(SPC)M
–
0.5tc(CO)
–
10
The MASTER/SLAVE bit (SPICTL.2) is set and the CLOCK PHASE bit (SPICTL.3) is cleared.
tc = system clock cycle time = 1/CLKOUT = tc(CO)
§
The active edge of the SPICLK signal referenced is controlled by the CLOCK POLARITY bit (SPICCR.6).
相關(guān)PDF資料
PDF描述
TMX320LF2407APGES INSUL WASHER 10 PR
TMP320LC2404APZA Transient Voltage Suppressor Diodes
TMP320LC2404APZS Transient Voltage Suppressor Diodes
TMP320LC2406APZA Transient Voltage Suppressor Diodes
TMP320LC2406APZS Transient Voltage Suppressor Diodes
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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TMS320-XDS100-V3 功能描述:仿真器/模擬器 XDS100V3 DSP / ARM HIGH SPEED USB JTAG RoHS:否 制造商:Blackhawk 產(chǎn)品:System Trace Emulators 工具用于評估:C6000, C5000, C2000, OMAP, DAVINCI, SITARA, TMS470, TMS570, ARM 7/9, ARM Cortex A8/R4/M3 用于:XDS560v2
TMS32AV110PBM 制造商:Rochester Electronics LLC 功能描述:- Bulk 制造商:Texas Instruments 功能描述:
TMS32C31PQA40 制造商:Texas Instruments 功能描述:
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