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參數(shù)資料
| 型號(hào)： | TMP86PS27FG |
| 廠商： | Toshiba Corporation |
| 英文描述： | Zener Diode; Application: General; Pd (mW): 500; Vz (V): 6.6 to 6.9; Condition Iz at Vz (mA): 5; C (pF) max: -; Condition VR at C (V):   ESD (kV) min: -; Package: DO-35 |
| 中文描述： | 8位微控制器 |
| 文件頁數(shù)： | 92/206頁 |
| 文件大?。?/td> | 1415K |
| 代理商： | TMP86PS27FG |
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Page 82
8. 10-Bit Timer/Counter (TC7)
8.2 Control
TMP86PS27FG
Note 1: Data registers TC7DRA to TC7DRE have double-stage configuration, consisting of a data register that stores data written
by an instruction and a compare register to be compared with the counter.
Note 2: When writing data to data registers TC7DRA to TC7DRE, first write the lower byte and then the upper byte.
Note 3: Unused bits (Bits 10 to 15) in the upper bytes of data registers TC7DRA to TC7DRE are not assigned specific register
functions. These bits are always read as 0 even when a 1 is written.
Note 4: Values read from data registers TC7DRA to TC7DRE may differ from the actual PPG output waveforms due to their dou-
ble-stage configuration.
Note 5: Data registers are not updated by merely modifying the output mode with TC7CR2<TC7OUT>. After modifying the output
mode, reconfigure data registers TC7DRA to TC7DRE. Ensure that the data registers are written in an appropriate order
because they are not enabled until the upper byte of the TC7DRC is written.
Note 1: Capture registers (TC7CAPA and TC7CAPB) must be read in the following order: Lower byte of the TC7CAPA, upper byte
of the TC7CAPA, lower byte of the TC7CAPB, upper byte of the TC7CAPB.
Note 2: The next captured data is not updated by reading the TC7CAPA only. The TC7CAPB must also be read.
Note 3: It is possible to read the TC7CAPB only. Read the lower byte first.
Note 4: If a capture edge is not detected within a period, the previous capture value is maintained in the next period.
Note 5: If more than one capture edge is detected within a period, the capture value for the edge detected last is valid in the next
period.
Note 6: Bits 10 to 15 of the TC7CAPA and TC7CAPB are always read as 0.
Dead Time 2 Setup Register
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
TC7DRD
TC7DRDH
(0FB1H)
TC7DRDL
(0FB0H)
(0FB1H, 0FB0H) Read/Write (Initial value: **** **00 0000 0000)
Pulse Width 2 Setup Register
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
TC7DRE
TC7DREH
(0FB3H)
TC7DREL
(0FB2H)
(0FB3H, 0FB2H) Read/Write (Initial value: **** **00 0000 0000)
Rising-edge Capture Value Register
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
TC7CAPA
TC7CAPAH
(0FB5H)
TC7CAPAL
(0FB4H)
(0FB5H, 0FB4H) Read only (Initial value: 0000 00** **** ****)
Falling-edge Capture Value Register
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
TC7CAPB
TC7CAPBH
(0FB7H)
TC7CAPBL
(0FB6H)
(0FB7H, 0FB6H) Read only (Initial value: 0000 00** **** ****)
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PDF描述 |
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