參數(shù)資料
型號(hào)： TMP86PS27FG
廠商： Toshiba Corporation
英文描述： Zener Diode; Application: General; Pd (mW): 500; Vz (V): 6.6 to 6.9; Condition Iz at Vz (mA): 5; C (pF) max: -; Condition VR at C (V):   ESD (kV) min: -; Package: DO-35
中文描述： 8位微控制器
文件頁數(shù)： 79/206頁
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代理商： TMP86PS27FG
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Page 69
TMP86PS27FG
6.2
Divider Output (
DVO
)
Approximately 50% duty pulse can be output using the divider output circuit, which is useful for piezoelectric
buzzer drive. Divider output is from
DVO
pin.
6.2.1
Configuration
Figure 6-3 Divider Output
6.2.2
Control
The Divider Output is controlled by the Time Base Timer Control Register.
Note: Selection of divider output frequency (DVOCK) must be made while divider output is disabled (DVOEN="0"). Also, in other
words, when changing the state of the divider output frequency from enabled (DVOEN="1") to disable(DVOEN="0"), do not
change the setting of the divider output frequency.
Time Base Timer Control Register
7
6
5
4
3
2
1
0
TBTCR
(0036H)
DVOEN
DVOCK
(DV7CK)
(TBTEN)
(TBTCK)
(Initial value: 0000 0000)
DVOEN
Divider output
enable / disable
0: Disable
1: Enable
R/W
DVOCK
Divider Output (
DVO
)
frequency selection: [Hz]
NORMAL1/2, IDLE1/2 Mode
SLOW1/2
SLEEP1/2
Mode
R/W
DV7CK = 0
DV7CK = 1
00
fc/2
13
fs/2
5
fs/2
5
01
fc/2
12
fs/2
4
fs/2
4
10
fc/2
11
fs/2
3
fs/2
3
11
fc/2
10
fs/2
2
fs/2
2
TBTCR
Output latch
Port output latch
MPX
A
B
C
D
S
DVOEN
TBTCR<DVOEN>
DVO pin output
DVOCK
Divider output control register
(a) configuration
(b) Timing chart
Data output
2
Y
D
Q
DVO pin
fc/2
13
or fs/2
5
fc/2
12
or fs/2
4
fc/2
11
or fs/2
3
fc/2
10
or fs/2
2
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PDF描述
TMP86PS43F CMOS 8-Bit MICOROcontroller
TMP86PS44UG Zener Diode; Application: General; Pd (mW): 500; Vz (V): 6.7 to 7.0; Condition Iz at Vz (mA): 5; C (pF) max: -; Condition VR at C (V): &#160; ESD (kV) min: -; Package: DO-35
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