參數(shù)資料
型號： ST72F60E1M1
廠商： STMICROELECTRONICS
元件分類： 微控制器/微處理器
英文描述： 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PDSO24
封裝： 0.300 INCH, LEAD FREE, PLASTIC, SOP-24
文件頁數(shù)： 100/139頁
文件大小： 1993K
代理商： ST72F60E1M1
ST7260xx
Watchdog timer (WDG)
63/139
12.4.6
Summary of timer modes
12.4.7
16-bit timer registers
Each timer is associated with three control and status registers, and with six pairs of data
registers (16-bit values) relating to the two input captures, the two output compares, the
counter and the alternate counter.
Control Register 1 (CR1)
M
Table 30.
Summary of timer modes
Mode
Timer resources
Input
capture 1
Input
capture 2
Output
compare 1
Output
compare 2
Input Capture
(1 and/or 2)
Yes
Output Compare
(1 and/or 2)
One Pulse mode
No
Not recommended(1)
1.
No
Partially(2)
2.
PWM mode
Not recommended(3)
3.
No
CR1
Reset value: 0000 0000 (00h)
76
543
21
0
ICIE
OCIE
TOIE
FOLV2
FOLV1
OLVL2
IEDG1
OLVL1
R/W
Table 31.
CR1 register description
Bit
Name
Function
7ICIE
Input Capture Interrupt Enable
0: Interrupt is inhibited.
1: A timer interrupt is generated whenever the ICF1 or ICF2 bit of the SR register is
set.
6OCIE
Output Compare Interrupt Enable
0: Interrupt is inhibited.
1: A timer interrupt is generated whenever the OCF1 or OCF2 bit of the SR register
is set.
5TOIE
Timer Overflow Interrupt Enable
0: Interrupt is inhibited.
1: A timer interrupt is enabled whenever the TOF bit of the SR register is set.
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