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參數(shù)資料
| 型號： | ST10F296TR |
| 廠商： | STMICROELECTRONICS |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-BIT, FLASH, 64 MHz, MICROCONTROLLER, PBGA208 |
| 封裝： | 23 X 23 MM, 1.96 MM HEIGHT, 1.27 MM PITCH, ROHS COMPLIANT, PLASTIC, BGA-208 |
| 文件頁數(shù)： | 232/346頁 |
| 文件大?。?/td> | 5607K |
| 代理商： | ST10F296TR |
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ST10F296E
Electrical characteristics
307/346
Input leakage and external circuit
with a large source of impedance, can lead to a degradation of the ADC accuracy when
input leakage is present.
Data about maximum input leakage current at each pin is provided in Section 24.5: DC
characteristics. Input leakage is greatest at high operating temperatures and generally
decreases by one half a degree for each 10 °C decrease in temperature.
Considering that one count of a 10-bit ADC is about 5 mV (assuming VAREF = 5 V), an input
leakage of 100 nA acting though an RL = 50 k of external resistance, leads to an error of
exactly one count (5 mV). If the resistance is 100 k
, the error is two counts (10 mV).
Additional leakage due to external clamping diodes must also be taken into account in
computing the total leakage affecting the ADC measurements. Another contribution to the
total leakage is represented by the charge sharing effects with the sampling capacitance.
The sampling capacitance, CS, is essentially a switched capacitance with a frequency equal
to the conversion rate of a single channel (maximum when the fixed channel continuous
conversion mode is selected). It can be seen as a resistive path to ground. For instance,
assuming a conversion rate of 250 kHz and a CS of 4 pF, a resistance of 1 M is obtained
(REQ = 1/fCCS, where fC represents the conversion rate at the considered channel). To
minimize the error induced by the voltage partitioning between this resistance (sampled
voltage on CS) and the sum of RS + RF + RL + RSW + RAD, the external circuit must be
designed to respect the following relation:
Equation 25
Equation 25 places constraints on the external network design, in particular on the resistive
path.
A second aspect of the capacitance network must be considered. Assuming the three
capacitances, CF, CP1 and CP2, are initially charged at the source voltage VA (see
Figure 99), when the sampling phase is started (ADC switch closed), a charge-sharing
phenomena begins (see Figure 100).
Figure 100. Charge sharing timing diagram during sampling phase
Two different transient periods can be distinguished in Figure 100. They are described
below.
V
A
R
S
R
F
R
L
R
SW
R
AD
++
+
() R
EQ
×
12
()LSB
<
VA
VA1
VA2
t
TS
VCS
Voltage transient on CS
V < 0.5 LSB
1
2
τ 1 < (RSW + RAD) CS << TS
τ 2 = RL (CS + CP1 + CP2)
相關PDF資料 |
PDF描述 |
|---|---|
| ST10R172LT6 | 16-BIT, 50 MHz, MICROCONTROLLER, PQFP100 |
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相關代理商/技術參數(shù) |
參數(shù)描述 |
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| ST10-IP-EE (5000-182) | 功能描述:電機驅動器 RoHS:否 制造商:Applied Motion 電機驅動類型:2035 Step 電源電壓:12 V to 35 V 功率額定值:70 W 每轉步距分辨率:200 to 400 框架大小 (NEMA): |
| ST10-IP-EN | 功能描述:電機驅動器 RoHS:否 制造商:Applied Motion 電機驅動類型:2035 Step 電源電壓:12 V to 35 V 功率額定值:70 W 每轉步距分辨率:200 to 400 框架大小 (NEMA): |
| ST10-IP-EN (5000-181) | 功能描述:電機驅動器 RoHS:否 制造商:Applied Motion 電機驅動類型:2035 Step 電源電壓:12 V to 35 V 功率額定值:70 W 每轉步距分辨率:200 to 400 框架大小 (NEMA): |
| ST10-PE | 制造商:Phoenix Contact 功能描述:TERMINAL ST 10-PE |
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