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參數(shù)資料
| 型號(hào)： | SI5338A-A-GM |
| 廠商： | Silicon Laboratories Inc |
| 文件頁(yè)數(shù)： | 42/44頁(yè) |
| 文件大小： | 0K |
| 描述： | IC CLK GEN QUAD 700MHZ 24-QFN |
| 標(biāo)準(zhǔn)包裝： | 490 |
| 系列： | MultiSynth™ |
| 類型： | 時(shí)鐘發(fā)生器 |
| PLL： | 是 |
| 輸入： | CML，HCSL，HSCL，LVDS，LVPECL，晶體 |
| 輸出： | CMOS，HCSL. HSTL. LVDS. LVPECL. SSTL |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 2:4 |
| 差分 - 輸入:輸出： | 是/是 |
| 頻率 - 最大： | 700MHz |
| 除法器/乘法器： | 是/是 |
| 電源電壓： | 1.71 V ~ 3.63 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 24-VFQFN 裸露焊盤 |
| 供應(yīng)商設(shè)備封裝： | 24-QFN（4x4） |
| 包裝： | 托盤 |
| 產(chǎn)品目錄頁(yè)面： | 628 (CN2011-ZH PDF) |
| 配用： | 336-1747-ND - KIT PROG FIELD SI5338/4/0 336-1556-ND - BOARD EVALUATION SI5338 |
| 其它名稱： | 336-1553-5 |
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Si5338
Rev. 1.3
7
Phase Increment/Decrement
Update Time
PUPDATE
Pin control2,3
MultiSynth output <18 MHz
Number of periods of
MultiSynth output frequency
—10
12
Periods
Frequency Increment/
Decrement Step Size
fSTEP
R divider not used
1
—
See
Note 2
ppm
MultiSynth range for frequency
increment/decrement
fRANGE
R divider not used
5
—
Fvco/8
MHz
Frequency Increment/
Decrement Update Time
fUPDATE
Pin control2,3
MultiSynth output >18 MHz
——
667
ns
Frequency Increment/
Decrement Update Time
fUPDATE
Pin control2,3
MultiSynth output <18 MHz
Number of periods of
MultiSynth output frequency
—10
12
Periods
Spread Spectrum PP
Frequency Deviation
SSDEV
MultiSynth Output < ~Fvco/8
0.1
—
5.04
%
Spread Spectrum Modulation
Rate
SSDEV
MultiSynth Output < ~Fvco/8
30
—
635
kHz
Table 5. Performance Characteristics (Continued)
(VDD = 1.8 V –5% to +10%, 2.5 V ±10%, or 3.3 V ±10%, TA = –40 to 85 °C)
Parameter
Symbol
Test Condition
Min
Typ
Max
Unit
Notes:
1. Outputs at integer-related frequencies and using the same driver format. See "3.10.3. Programmable Initial Phase
Offset" on page 26.
2. The maximum step size is only limited by the register lengths; however, the MultiSynth output frequency must be kept
between 5 MHz and Fvco/8.
3. Update rate via I2C is also limited by the time it takes to perform a write operation.
4. Default value is 0.5% down spread.
5. Default value is ~31.5 kHz.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| ICS87608AYILF | IC CLK GEN ZD PCI/PCI-X 32-LQFP |
| VI-2VP-MX-B1 | CONVERTER MOD DC/DC 13.8V 75W |
| ICS87002AG-02LF | IC CLK GENERATOR ZD 1:2 20-TSSOP |
| VI-B43-MW-B1 | CONVERTER MOD DC/DC 24V 100W |
| VI-B1Z-MV-B1 | CONVERTER MOD DC/DC 2V 60W |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| SI5338A-A-GMR | 功能描述:時(shí)鐘發(fā)生器及支持產(chǎn)品 I2C-program Clk gen 0.16 - 710 MHz RoHS:否 制造商:Silicon Labs 類型:Clock Generators 最大輸入頻率:14.318 MHz 最大輸出頻率:166 MHz 輸出端數(shù)量:16 占空比 - 最大:55 % 工作電源電壓:3.3 V 工作電源電流:1 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:QFN-56 |
| SI5338A-B00302-GM | 制造商:Silicon Laboratories Inc 功能描述:CLOCK - Bulk |
| SI5338A-B00302-GMR | 制造商:Silicon Laboratories Inc 功能描述:CLOCK - Tape and Reel |
| SI5338A-B00419-GM | 制造商:Silicon Laboratories Inc 功能描述:CLOCK - Bulk |
| SI5338A-B01206-GM | 制造商:Silicon Laboratories Inc 功能描述:CLOCK - Bulk |
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