- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄9189 > SI5338A-A-GM (Silicon Laboratories Inc)IC CLK GEN QUAD 700MHZ 24-QFN PDF資料下載
參數(shù)資料
| 型號： | SI5338A-A-GM |
| 廠商： | Silicon Laboratories Inc |
| 文件頁數(shù)： | 17/44頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CLK GEN QUAD 700MHZ 24-QFN |
| 標準包裝： | 490 |
| 系列： | MultiSynth™ |
| 類型： | 時鐘發(fā)生器 |
| PLL： | 是 |
| 輸入： | CML，HCSL，HSCL，LVDS，LVPECL，晶體 |
| 輸出： | CMOS，HCSL. HSTL. LVDS. LVPECL. SSTL |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 2:4 |
| 差分 - 輸入:輸出： | 是/是 |
| 頻率 - 最大： | 700MHz |
| 除法器/乘法器： | 是/是 |
| 電源電壓： | 1.71 V ~ 3.63 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 24-VFQFN 裸露焊盤 |
| 供應(yīng)商設(shè)備封裝： | 24-QFN（4x4） |
| 包裝： | 托盤 |
| 產(chǎn)品目錄頁面： | 628 (CN2011-ZH PDF) |
| 配用： | 336-1747-ND - KIT PROG FIELD SI5338/4/0 336-1556-ND - BOARD EVALUATION SI5338 |
| 其它名稱： | 336-1553-5 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁當(dāng)前第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁
Si5338
24
Rev. 1.3
Figure 13. Output Enable Control Registers
3.8. Power Consumption
The Si5338 Power consumption is a function of
Supply voltage
Frequency of output Clocks
Number of output Clocks
Format of output Clocks
Because of internal voltage regulation, the current from
the core VDD is independent of the VDD voltage and
hence the plot shown in Figure 14 can be used to
estimate the VDD core (pins 7 and 24) current.
The current from the output supply voltages can be
estimated from the values provided in Table 3, “DC
Characteristics,” on page 5. To get the most accurate
value
for
VDD
currents,
the
Si5338-EVB
with
Clockbuilder software should be used. To do this, go to
the
“Power”
tab
of
the
Clockbuilder
and
press
“Measure”. In this manner, a specific configuration can
be implemented on the EVB and the actual current for
each supply voltage measured. When doing this it is
critical that the output drivers have the proper load
impedance for the selected format.
When testing for output driver current with HSTL and
SSTL, it is required to have load circuitry as shown in
“AN408: Termination Options for Any-Frequency, Any-
Output Clock Generators and Clock Buffers”. The
Si5338 EVB has layout pads that can be used for this
purpose. When testing for output driver current with
LVPECL the same layout pads can be used to
implement the LVPECL bias resistor of 130
(2.5 V
VDDx) or 200
(3.3 V VDDx). See the schematic in the
Si5338-EVB data sheet and AN408 for additional
information.
230
OEB
0
OEB
1
OEB
2
OEB
3
OEB
All
1
2
3
4
5
6
7
0 = enable
1 = disable
110
0
1
2
3
4
5
6
7
CLK0 OEB
State
114
0
1
2
3
4
5
6
7
CLK1 OEB
State
118
0
1
2
3
4
5
6
7
CLK2 OEB
State
122
0
1
2
3
4
5
6
7
CLK3 OEB
State
00 = disabled tri-state
01 = disabled low
10 = disabled high
11 = always enabled
Bits reserved
Bits used by other functions
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| ICS87608AYILF | IC CLK GEN ZD PCI/PCI-X 32-LQFP |
| VI-2VP-MX-B1 | CONVERTER MOD DC/DC 13.8V 75W |
| ICS87002AG-02LF | IC CLK GENERATOR ZD 1:2 20-TSSOP |
| VI-B43-MW-B1 | CONVERTER MOD DC/DC 24V 100W |
| VI-B1Z-MV-B1 | CONVERTER MOD DC/DC 2V 60W |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| SI5338A-A-GMR | 功能描述:時鐘發(fā)生器及支持產(chǎn)品 I2C-program Clk gen 0.16 - 710 MHz RoHS:否 制造商:Silicon Labs 類型:Clock Generators 最大輸入頻率:14.318 MHz 最大輸出頻率:166 MHz 輸出端數(shù)量:16 占空比 - 最大:55 % 工作電源電壓:3.3 V 工作電源電流:1 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:QFN-56 |
| SI5338A-B00302-GM | 制造商:Silicon Laboratories Inc 功能描述:CLOCK - Bulk |
| SI5338A-B00302-GMR | 制造商:Silicon Laboratories Inc 功能描述:CLOCK - Tape and Reel |
| SI5338A-B00419-GM | 制造商:Silicon Laboratories Inc 功能描述:CLOCK - Bulk |
| SI5338A-B01206-GM | 制造商:Silicon Laboratories Inc 功能描述:CLOCK - Bulk |
發(fā)布緊急采購，3分鐘左右您將得到回復(fù)。