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參數(shù)資料
| 型號(hào)： | S5935_07 |
| 廠商： | Applied Micro Circuits Corp. |
| 英文描述： | PCI Product |
| 中文描述： | 的PCI產(chǎn)品 |
| 文件頁數(shù)： | 48/204頁 |
| 文件大?。?/td> | 1897K |
| 代理商： | S5935_07 |
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S5935 – PCI Product
48 DS1527
AMCC Confidential and Proprietary
Revision 1.02 – June 27, 2006
Data Book
BUILT-IN SELF-TEST REGISTER (BIST)
The Built-In Self-Test (BIST) register permits the
implementation of custom, user-specific diagnostics.
This register has four fields as depicted in Figure 10.
Bit 7, when set signifies that this device supports a
built-in self test. When bit 7 is set, writing a 1 to bit 6
will commence the self test. In actuality, writing a 1 to
bit 6 produces an interrupt to the Add-On interface. Bit
6 will remain set until cleared by a write operation to
this register from the Add-On bus interface. When bit 6
is reset it is interpreted as completion of the self-test
and an error is indicated by a non-zero value for the
completion code (bits 3:0).
Figure 17. Built-In Self Test Register
Register Name
Built-in Self-Test
Address Offset
0Fh
Power-up value
00h
Boot-load
External nvRAM/EPROM offset 04Fh
Attribute
D7, D5-0 Read Only, D6 as PCI bus
write only
Size
8 bits
Table 24. Built-In Self-Test Register
Bit
Description
7
BIST Capable. This bit indicates that the Add-On device supports a built-in self-test when a one is returned. A zero
should be returned if this self test feature is not desired. This field is read only from the PCI interface.
6
Start BIST. Writing a 1 to this bit indicates that the self-test should commence. This bit can only be written when bit 7 is
a 1. When bit 6 becomes set, an interrupt is issued to the Add-On interface. Other than through the reset pin, Bit 6 can
only be cleared by a write to this element from the Add-On bus interface as outlined in Section 6.5. The PCI bus spec-
ification requires that this bit be cleared within 2 seconds after being set, or the device will be failed.
5:4
Reserved. These bits are reserved. This field will always return zeros.
3:0
Completion Code. This field provides a method for detailing a device-specific error. It is considered valid when the Start
BIST field (bit 6) changes from 1 to 0. An all-zero value for the completion code indicates successful completion.
7
0
X
1
X
2
X
3
X
4
0
5
0
6
0
X
Bit
Value
User defined
Completion Code (RO)
Reserved (RO)
Start BIST (WO)
BIST Capable (RO)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| S5935QRC | PCI Product |
| S5935TFC | PCI Product |
| S5935TF | PCI 5V Bus Master/Target Device 32-bit |
| S5935 | PCI 5V Bus Master/Target Device 32-bit |
| S5935QF | PCI 5V Bus Master/Target Device 32-bit |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| S59355QRC | 制造商:AppliedMicro 功能描述: |
| S5935QF | 制造商:AMCC 制造商全稱:Applied Micro Circuits Corporation 功能描述:PCI Product |
| S5935QRC | 制造商:AppliedMicro 功能描述:PCI Master Device 160-Pin PQFP |
| S5935TF | 制造商:AMCC 制造商全稱:Applied Micro Circuits Corporation 功能描述:PCI 5V Bus Master/Target Device 32-bit |
| S5935TFC | 制造商:AMCC 制造商全稱:Applied Micro Circuits Corporation 功能描述:PCI Product |
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