參數(shù)資料
型號： S3C1850XX-SM
元件分類： 微控制器/微處理器
英文描述： 4-BIT, MROM, 6 MHz, MICROCONTROLLER, PDSO24
封裝： 0.375 INCH, SOP-24
文件頁數(shù)： 9/89頁
文件大?。?/td> 323K
代理商： S3C1850XX-SM
S3C1850
2-16
System Reset
Internal
HALT
The Auto-Reset Counter is cleared every 131,072/fxx (288 msec if fxx is 455 KHz).
Power-on Reset
Auto-Reset Counter
Internal
HALT
Internal P2.0
fXX
CLK
CLR
Figure 2-18. Auto Reset Block Diagram
OSC DIVIDE OPTION CIRCUIT
The OSC Divide Option Circuit provides a maximum 1MHz fxx system clock. f
OSC which is generated in
oscillation circuit is divided eight or non-divide in this circuit to produce fxx. This dividing ratio will be chosen by
mask option. (See Figure 2-19)
f
OSC : Oscillator clock
fxx : System clock (f
OSC or fOSC /8)
f
CPU: CPU clock (fCPU = fxx/6)
1 instruction cycle clock
XI
XO
f
OSC
Mask Option
OSC
DIVIDE-8
fXX
Figure 2-19. S3C1850 OSC Divide Option Circuit
相關(guān)PDF資料
PDF描述
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S3C72M9XX-QA 4-BIT, MROM, 6 MHz, MICROCONTROLLER, PQFP128
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