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參數資料
| 型號： | RM5231 |
| 廠商： | PMC-Sierra, Inc. |
| 英文描述： | RM5231⑩ Microprocessor with 32-Bit System Bus Data Sheet Released |
| 中文描述： | RM5231⑩微處理器與32位系統(tǒng)總線的數據資料發(fā)布 |
| 文件頁數： | 34/39頁 |
| 文件大?。?/td> | 630K |
| 代理商： | RM5231 |
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Proprietary and Confidential to PMC-Sierra, Inc and for its Customer
’
s Internal Use
Document ID: PMC-2002165, Issue 1
34
RM5231
Microprocessor with 32-bit System Bus Data Sheet
Released
9.3
System Interface Parameters
1
9.4
Boot-Time Interface Parameters
Parameter
Data Output
2,3
t
DO
Symbol
Conditions
150
–
250 MHz CPU
Speed
Min
Max
1.0
4.5
Units
ns
mode14..13 = 10 (fastest)
5
mode14..13 = 11
5
1.0
5.0
ns
mode14..13 = 00
5
1.0
5.5
ns
mode14..13 = 01 (slowest)
5
t
rise
= see above table
t
fall
= see above table
1.0
6.0
ns
Data Setup
4
t
DS
2.5
ns
Data Hold
4
Notes
1.
Timings are measured from 1.5 V of the clock to 1.5 V of the signal.
2.
Capacitive load for all maximum output timings is 50 pF. Minimum output timings are for a theoretical no
load condition - untested.
3.
Data Output timing applies to all signal pins whether tristate I/O or output only.
4.
Setup and Hold parameters apply to all signal pins whether tristate I/O or input only.
5.
Only mode 14:13 = 00 is tested and guaranteed.
t
DH
1.0
ns
Parameter
Mode Data Setup
Symbol
t
DS
(M)
t
DH
(M)
CPU Speed
150
–
250 MHz
Min
4
Units
SysClock cycles
Max
Mode Data Hold
0
SysClock cycles
相關PDF資料 |
PDF描述 |
|---|---|
| RM5231-200-Q | RM5231⑩ Microprocessor with 32-Bit System Bus Data Sheet Released |
| RM5231-250-Q | RM5231⑩ Microprocessor with 32-Bit System Bus Data Sheet Released |
| RM5231A | RM5231A⑩ Microprocessor with 32-Bit System Bus Data Sheet Preliminary |
| RM5231A-250-H | RM5231A⑩ Microprocessor with 32-Bit System Bus Data Sheet Preliminary |
| RM5231A-300-H | RM5231A⑩ Microprocessor with 32-Bit System Bus Data Sheet Preliminary |
相關代理商/技術參數 |
參數描述 |
|---|---|
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| RM5231-200Q | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:64-Bit Microprocessor |
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