參數(shù)資料
型號(hào)： R5S72691P266BG
元件分類： 微控制器/微處理器
英文描述： 32-BIT, FLASH, 266.67 MHz, RISC MICROCONTROLLER, PBGA272
封裝： 17 X 17 MM, 0.80 MM PITCH, PLASTIC, LFBGA-272
文件頁數(shù)： 24/445頁
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代理商： R5S72691P266BG
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Page xii of liv
6.9.5
Note before Exception Handling Begins Running............................................ 164
Section 7 Interrupt Controller............................................................................ 167
7.1
Features............................................................................................................................. 167
7.2
Input/Output Pins.............................................................................................................. 169
7.3
Register Descriptions........................................................................................................ 170
7.3.1
Interrupt Priority Registers 01, 02, 05 to 26
(IPR01, IPR02, IPR05 to IPR26) ...................................................................... 172
7.3.2
Interrupt Control Register 0 (ICR0).................................................................. 175
7.3.3
Interrupt Control Register 1 (ICR1).................................................................. 177
7.3.4
Interrupt Control Register 2 (ICR2).................................................................. 178
7.3.5
IRQ Interrupt Request Register (IRQRR)......................................................... 179
7.3.6
PINT Interrupt Enable Register (PINTER)....................................................... 180
7.3.7
PINT Interrupt Request Register (PIRR) .......................................................... 181
7.3.8
Bank Control Register (IBCR).......................................................................... 182
7.3.9
Bank Number Register (IBNR) ........................................................................ 183
7.4
Interrupt Sources...............................................................................................................184
7.4.1
NMI Interrupt.................................................................................................... 184
7.4.2
User Break Interrupt ......................................................................................... 185
7.4.3
User Debugging Interface Interrupt .................................................................. 185
7.4.4
IRQ Interrupts................................................................................................... 185
7.4.5
PINT Interrupts ................................................................................................. 186
7.4.6
On-Chip Peripheral Module Interrupts ............................................................. 187
7.5
Interrupt Exception Handling Vector Table and Priority.................................................. 189
7.6
Operation .......................................................................................................................... 205
7.6.1
Interrupt Operation Sequence ........................................................................... 205
7.6.2
Stack after Interrupt Exception Handling ......................................................... 208
7.7
Interrupt Response Time................................................................................................... 209
7.8
Register Banks ..................................................................................................................216
7.8.1
Banked Register and Input/Output of Banks .................................................... 217
7.8.2
Bank Save and Restore Operations................................................................... 217
7.8.3
Save and Restore Operations after Saving to All Banks................................... 219
7.8.4
Register Bank Exception .................................................................................. 220
7.8.5
Register Bank Error Exception Handling ......................................................... 220
7.9
Data Transfer with Interrupt Request Signals................................................................... 221
7.9.1
Handling Interrupt Request Signals as Sources for
CPU Interrupt but Not Direct Memory Access Controller Activating .............. 222
7.9.2
Handling Interrupt Request Signals as Sources for
Activating Direct Memory Access Controller but Not CPU Interrupt .............. 222
7.10
Usage Note ....................................................................................................................... 223
相關(guān)PDF資料
PDF描述
R5S72691P266FP 32-BIT, FLASH, 266.67 MHz, RISC MICROCONTROLLER, PQFP256
R6202230XXOO 300 A, 2200 V, SILICON, RECTIFIER DIODE
R8206-1 82 SERIES, 16-BIT ERROR DETECT AND CORRECT CKT, CQCC68
R8A66150SP 12 I/O, PIA-GENERAL PURPOSE, PDSO20
R921019000 INTERCONNECTION DEVICE
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