參數(shù)資料
型號(hào)： QL6250E-8PQ208I
廠商： QUICKLOGIC CORP
元件分類： FPGA
英文描述： FPGA, 960 CLBS, 248160 GATES, PQFP208
封裝： 28 X 28 MM, 3.35 MM HEIGHT, MS-028, PLASTIC, QFP-208
文件頁(yè)數(shù)： 20/64頁(yè)
文件大?。?/td> 850K
代理商： QL6250E-8PQ208I
2006 QuickLogic Corporation
Eclipse-E Family Data Sheet Rev. A
27
Figure 29: Eclipse-E Global Clock Structure
NOTE: When using a PLL, t
PGCK and tBGCK are effectively zero due to delay adjustment by Phase Locked
Loop feedback path.
Figure 30: Global Clock Structure Timing Elements
Table 15: Eclipse-E Tree Clock Delay
Clock Segment
Parameter
Value
Min
Max
tPGCK
Global clock pin delay to quad net
-
1.92 ns
tBGCK
Global clock tree delay (quad net to flip-flop)
-
0.28 ns
tDPD
Dedicated clock pad
-
1.7 ns
tGSKEW
Global delay clock skew
-
0.1 ns
tDSKEW
Dedicated clock skew
-
0.05 ns
Quad net
Internally generated clock, or
clock from general routing network
Global Clock
(CLK) Input
Quad-Net Clock Network
FF
Global Clock Buffer
相關(guān)PDF資料
PDF描述
QL6250E-8PQ208M FPGA, 960 CLBS, 248160 GATES, PQFP208
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QL6250E-8PS484I FPGA, 960 CLBS, 248160 GATES, PBGA484
QL6250E-8PS484M FPGA, 960 CLBS, 248160 GATES, PBGA484
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參數(shù)描述
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QL63F5SA 制造商:未知廠家 制造商全稱:未知廠家 功能描述:InGaAlP Laser Diode
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