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參數(shù)資料
| 型號： | PM7382-PI |
| 廠商： | PMC-Sierra, Inc. |
| 英文描述： | FRAME ENGINE AND DATA LINK MANAGER 32P256 |
| 中文描述： | 框架引擎和數(shù)據(jù)鏈路管理32P256 |
| 文件頁數(shù)： | 298/330頁 |
| 文件大?。?/td> | 2508K |
| 代理商： | PM7382-PI |
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RELEASED
DATA SHEET
PM7382 FREEDM-32P256
ISSUE 3
PMC-2010333
FRAME ENGINE AND DATA LINK MANAGER 32P256
PROPRIETARY AND CONFIDENTIAL TO PMC-SIERRA,INC., AND FOR ITS CUSTOMERS’ INTERNAL USE
287
13
FUNCTIONAL TIMING
13.1 Receive H-MVIP Link Timing
The timing relationship of the receive data clock (RMV8DC), frame pulse clock
(RMV8FPC), data (RD[n]) and frame pulse (RFP8B[n]) signals of a link
configured for 8.192 Mbps H-MVIP operation with a type 0 frame pulse is shown
in Figure 23. The falling edges of each RMV8FPC are aligned to a falling edge
of the corresponding RMV8DC for 8.192 Mbps H-MVIP operation. The
FREEDM-32P256 samples RFP8B low on the falling edge of RMV8FPC and
references this point as the start of the next frame. The FREEDM-32P256
samples the data provided on RD[n] at the point of the data bit using the rising
edge of RMV8DC as indicated for bit 1 (B1) of time-slot 0 (TS 0) in Figure 23.
B1 is the most significant bit and B8 is the least significant bit of each octet.
Time-slots can be ignored by setting the PROV bit in the corresponding word of
the receive channel provision RAM in the RCAS256 block to low.
Figure 23 – Receive 8.192 Mbps H-MVIP Link Timing
RMV8DC
(16 MHz)
RFP8B
RD[n]
B8
B1
B2
B3
B4
B5
B6
B7
B8
B1
TS 127
TS 0
TS 1
RMV8FPC
(4 MHz)
where 8n m 8n+7) and frame pulse (RFPB[n]) signals of a link configured for
2.048 Mbps H-MVIP operation with a type 0 frame pulse is shown in Figure 24.
The FREEDM-32P256 samples RFPB[n] low on the falling edge of the
corresponding RMVCK[n] and references this point as the start of the next
frame. The FREEDM-32P256 samples the data provided on RD[m] at the
point of the data bit using the rising edge of the corresponding RMVCK[n] as
indicated for bit 1 (B1) of time-slot 0 (TS 0) in Figure 24. B1 is the most
significant bit and B8 is the least significant bit of each octet. Time-slots can be
ignored by setting the PROV bit in the corresponding word of the receive channel
provision RAM in the RCAS256 block to low.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PM7382 | Frame Engine and Data Link Manager 32P256 |
| PM7383 | FRAME ENGINE AND DATA LINK MANAGER 32A256 |
| PM7383-PI | FRAME ENGINE AND DATA LINK MANAGER 32A256 |
| PM7384 | Frame Engine and Data Link Manager |
| PM7384-BI | FRAME ENGINE AND DATA LINK MANAGER 84P672 |
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參數(shù)描述 |
|---|---|
| PM7383 | 制造商:PMC 制造商全稱:PMC 功能描述:FRAME ENGINE AND DATA LINK MANAGER 32A256 |
| PM7383-PI | 制造商:PMC 制造商全稱:PMC 功能描述:FRAME ENGINE AND DATA LINK MANAGER 32A256 |
| PM7384 | 制造商:PMC 制造商全稱:PMC 功能描述:Frame Engine and Data Link Manager |
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