參數(shù)資料
型號： PIC18F85J90
廠商： Microchip Technology Inc.
英文描述： 64/80-Pin, High-Performance Microcontrollers with LCD Driver and nanoWatt Technology
中文描述： 64/80-Pin，高性能的LCD驅(qū)動器和納瓦技術(shù)的微控制器
文件頁數(shù)： 405/411頁
文件大?。?/td> 3047K
代理商： PIC18F85J90
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PIC18F85J90 FAMILY
DS39770B-page 404
Preliminary
2007 Microchip Technology Inc.
OSCTUNE (Oscillator Tuning) ...................................31
PIE1 (Peripheral Interrupt Enable 1) ........................101
PIE2 (Peripheral Interrupt Enable 2) ........................102
PIE3 (Peripheral Interrupt Enable 3) ........................103
PIR1 (Peripheral Interrupt Request (Flag) 1) .............98
PIR2 (Peripheral Interrupt Request (Flag) 2) .............99
PIR3 (Peripheral Interrupt Request (Flag) 3) ...........100
RCON (Reset Control) .......................................46, 107
RCSTA1 (EUSART Receive Status and Control) ....231
RCSTA2 (AUSART Receive Status and Control) ....251
SSPCON1 (MSSP Control 1, I
2
C Mode) .................196
SSPCON1 (MSSP Control 1, SPI Mode) .................187
SSPCON2 (MSSP Control 2, I
2
C Master Mode) .....197
SSPCON2 (MSSP Control 2, I
2
C Slave Mode) .......198
SSPSTAT (MSSP Status, I
2
C Mode) .......................195
SSPSTAT (MSSP Status, SPI Mode) ......................186
STATUS .....................................................................73
STKPTR (Stack Pointer) ............................................60
T0CON (Timer0 Control) ..........................................131
T1CON (Timer1 Control) ..........................................135
T2CON (Timer2 Control) ..........................................141
T3CON (Timer3 Control) ..........................................143
TXSTA1 (EUSART Transmit Status and Control) ....230
TXSTA2 (AUSART Transmit Status and Control) ....250
WDTCON (Watchdog Timer Control) .......................289
RESET .............................................................................325
Reset ..................................................................................45
Brown-out Reset (BOR) .............................................45
MCLR Reset, During Power-Managed Modes ...........45
MCLR Reset, Normal Operation ................................45
Power-on Reset (POR) ..............................................45
RESET Instruction .....................................................45
Stack Full Reset .........................................................45
Stack Underflow Reset ..............................................45
Watchdog Timer (WDT) Reset ...................................45
Resets ..............................................................................283
Brown-out Reset (BOR) ...........................................283
Oscillator Start-up Timer (OST) ...............................283
Power-on Reset (POR) ............................................283
Power-up Timer (PWRT) .........................................283
RETFIE ............................................................................326
RETLW .............................................................................326
RETURN ..........................................................................327
Return Address Stack ........................................................59
Return Stack Pointer (STKPTR) ........................................60
RLCF ................................................................................327
RLNCF .............................................................................328
RRCF ...............................................................................328
RRNCF .............................................................................329
S
SCK ..................................................................................185
SDI ...................................................................................185
SDO .................................................................................185
SEC_IDLE Mode ................................................................42
SEC_RUN Mode ................................................................38
Serial Clock, SCK .............................................................185
Serial Data In (SDI) ..........................................................185
Serial Data Out (SDO) .....................................................185
Serial Peripheral Interface. See SPI Mode.
SETF ................................................................................329
Slave Select (SS) .............................................................185
SLEEP ..............................................................................330
Sleep
OSC1 and OSC2 Pin States ......................................36
Software Simulator (MPLAB SIM) ....................................346
Special Event Trigger. See Compare (CCP Module).
Special Features of the CPU ........................................... 283
SPI Mode (MSSP)
Associated Registers ............................................... 193
Bus Mode Compatibility ........................................... 193
Effects of a Reset .................................................... 193
Enabling SPI I/O ...................................................... 189
Master Mode ............................................................ 190
Master/Slave Connection ......................................... 189
Operation ................................................................. 188
Operation in Power-Managed Modes ...................... 193
Serial Clock .............................................................. 185
Serial Data In ........................................................... 185
Serial Data Out ........................................................ 185
Slave Mode .............................................................. 191
Slave Select ............................................................. 185
Slave Select Synchronization .................................. 191
SPI Clock ................................................................. 190
Typical Connection .................................................. 189
SS .................................................................................... 185
SSPOV ............................................................................ 219
SSPOV Status Flag ......................................................... 219
SSPSTAT Register
R/W Bit ............................................................ 199, 201
Stack Full/Underflow Resets .............................................. 61
SUBFSR .......................................................................... 341
SUBFWB ......................................................................... 330
SUBLW ............................................................................ 331
SUBULNK ........................................................................ 341
SUBWF ............................................................................ 331
SUBWFB ......................................................................... 332
SWAPF ............................................................................ 332
T
Table Pointer Operations (table) ........................................ 84
Table Reads/Table Writes ................................................. 61
TBLRD ............................................................................. 333
TBLWT ............................................................................. 334
Timer0 .............................................................................. 131
Associated Registers ............................................... 133
Clock Source Select (T0CS Bit) ............................... 132
Operation ................................................................. 132
Overflow Interrupt .................................................... 133
Prescaler ................................................................. 133
Switching Assignment ..................................... 133
Prescaler Assignment (PSA Bit) .............................. 133
Prescaler Select (T0PS2:T0PS0 Bits) ..................... 133
Prescaler. See Prescaler, Timer0.
Reads and Writes in 16-Bit Mode ............................ 132
Source Edge Select (T0SE Bit) ............................... 132
Timer1 .............................................................................. 135
16-Bit Read/Write Mode .......................................... 137
Associated Registers ............................................... 139
Interrupt ................................................................... 138
Operation ................................................................. 136
Oscillator .......................................................... 135, 137
Layout Considerations ..................................... 138
Oscillator, as Secondary Clock .................................. 31
Overflow Interrupt .................................................... 135
Resetting, Using the CCP Special Event Trigger .... 138
TMR1H Register ...................................................... 135
TMR1L Register ....................................................... 135
Use as a Clock Source ............................................ 137
Use as a Real-Time Clock ....................................... 138
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PDF描述
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