參數(shù)資料
型號(hào)： ORT82G5-1FN680I
廠商： Lattice Semiconductor Corporation
文件頁(yè)數(shù)： 61/119頁(yè)
文件大?。?/td> 0K
描述： IC TRANCEIVERS FPSC 680FPBGA
產(chǎn)品變化通告： Product Discontinuation 01/Aug/2011
標(biāo)準(zhǔn)包裝： 24
系列： *
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Lattice Semiconductor
ORCA ORT42G5 and ORT82G5 Data Sheet
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Figure 26. Mixed Rate Transmit Clocking for a Single Block (Similar Connections Would Be Used for Block B)
Receive Clock Source Selection and Recommended Clock Distribution
In the receive path, one clock per bank of four channels, called RCK78[A:B], is sent to the FPGA logic. The control
register bits RCKSEL[0:1][A:B] are used to select the clock source for these clocks. The selection of the source for
RCK78[A:B] is controlled by these bits as shown in Table 18.
Table 18. RCK78[A:B] Source Selection
In the receive channel alignment bypass mode the data and recovered clocks for the eight channels (four per SER-
DES quad) are independent. The data for each channel are synchronized to the recovered clock from that channel.
Figure 27. - Receive Clocking for a Single Quad (Similar Connections Would Be Used for Quad B)
RCKSEL0
RCKSEL1
Clock Source
0
Channel A
1
0
Channel B
0
1
Channel C
1
Channel D
Common Logic, Quad A
Channel AA
Channel AB
Channel AD
Channel AC
REFCLK[P:N]_A
2
100 MHz
TCK78A
TSYS_CLK_AA
TSYS_CLK_AC
TSYS_CLK_AB
TSYS_CLK_AD
FPGA
Logic
Two Channels of
2.0 Gbps (Full-Rate)
Outgoing Serial Data
Channel AA Selected
as Clock Source
50 MHz
÷ 2
25 MHz
Two Channels of
1.0 Gbps (Half-Rate)
Outgoing Serial Data
Common Logic, Quad A
Channel AA
Channel AB
Channel AD
Channel AC
REFCLK[P:N]_A
2
156.25 MHz
RCK78A
RWCKAA
RWCKAC
RSYS_CLK_A1
RSYS_CLK_A2
FPGA
Logic
Four Channels of
3.125 Gbps
Incoming Serial Data
78.125 MHz
RWCKAB
RWCKAD
All Recovered
Clocks at
78.125 MHZ
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PDF描述
ORT82G5-2FN680I IC TRANCEIVERS FPSC 680FPBGA
VI-J4H-IW-F4 CONVERTER MOD DC/DC 52V 100W
VI-J4H-IW-F3 CONVERTER MOD DC/DC 52V 100W
ORT82G5-1FN680C IC TRANCEIVERS FPSC 680FPBGA
ORT82G5-2FN680C IC TRANCEIVERS FPSC 680FPBGA
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參數(shù)描述
ORT82G5-1FN680I1 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 10368 LUT 372 I/O RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
ORT82G5-2BM680C 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 10368 LUT 372 I/O RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
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ORT82G5-2F680C 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 ORCA FPSC 2.7Gbits/s BP XCVR 643K RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
ORT82G5-2F680I 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 ORCA FPSC 2.7GBITS/s BP XCVR 643K RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
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