參數(shù)資料
型號： ORSO82G5-3FN680C
廠商： Lattice Semiconductor Corporation
文件頁數(shù)： 130/153頁
文件大小： 0K
描述： IC TRANCEIVERS FPSC 680FPBGA
產(chǎn)品變化通告： Product Discontinuation 01/Aug/2011
標準包裝： 24
系列： *
Lattice Semiconductor
ORCA ORSO42G5 and ORSO82G5 Data Sheet
78
Register Reset Conditions
The reset conditions for the registers vary depending on register type. See the tables and the accompanying text
for a description of the reset conditions.
Table 21. SERDES Alarm and Alarm Mask Register Descriptions – ORSO42G5
(0x)
Absolute
Address
Bit
Name
Reset
Value
(0x)
Description
Mode
SERDES Alarm Registers (Read Only) xx = [AC, AD, BC, BD]
30020 - AC
30030 - AD
30120 - BC
30130 - BD
[0]
RSVD
00
Reserved - May be non-zero
—
[1]
LKI_xx
Receive PLL Lock Indication, Channel xx.
LKI_xx = 1 indicates the receive PLL is locked.
Note that the PLL can either lock to the incom-
ing data or to RECLK_[A:B]. If the PLL is locked
to data and the data stream is terminated,
LKI_xx will go low until the PLL locks to
REFCLK_[A:B].
Both
[2:7]
RSVD
Reserved - May be non-zero
—
SERDES Alarm Mask Registers (Read/Write) xx = [AC, AD, BC, BD]
30021 - AC
30031 - AD
30121 - BC
30131 - BD
[0]
RSVD
FF
Reserved
—
[1]
MLKI_xx
Mask Receive PLL Lock Indication, Channel
MLKI_xx = 1 indicates LKI_xx is enabled
Both
[2:7]
RSVD
Reserved
—
相關(guān)PDF資料
PDF描述
PIC32MX675F256L-80I/PT IC MCU 32BIT 256KB FLASH 100TQFP
D38999/26FE26SC CONN PLUG 26POS STRAIGHT W/SCKT
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MS27656T17F99S CONN RCPT 23POS WALL MNT W/SCKT
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參數(shù)描述
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ORSPI4-1F1156I 功能描述:FPGA - 現(xiàn)場可編程門陣列 16192 LUT RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256
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