參數(shù)資料
型號： MSC7118VF1200
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 數(shù)字信號處理
英文描述： 0-BIT, 300 MHz, OTHER DSP, PBGA400
封裝： 17 X 17 MM, MAPBGA-400
文件頁數(shù)： 28/60頁
文件大?。?/td> 1528K
代理商： MSC7118VF1200
MSC7118 Low-Cost 16-bit DSP with DDR Controller Data Sheet, Rev. 7
Freescale Semiconductor
34
2.5.7
I2C Timing
Table 22. I2C Timing
No.
Characteristic
Fast
Unit
Min
Max
450
SCL clock frequency
0
400
kHz
451
Hold time START condition
(SCL clock period/2) – 0.3
—
μs
452
SCL low period
(SCL clock period/2) – 0.3
—
μs
453
SCL high period
(SCL clock period/2) – 0.1
—
μs
454
Repeated START set-up time (not shown in figure)
2
× 1/FBCK
—
μs
455
Data hold time
0
—
μs
456
Data set-up time
250
—
ns
457
SDA and SCL rise time
—
700
ns
458
SDA and SCL fall time
—
300
ns
459
Set-up time for STOP
(SCL clock period/2) – 0.7
—
μs
460
Bus free time between STOP and START
(SCL clock period/2) – 0.3
—
μs
Note:
SDA set-up time is referenced to the rising edge of SCL. SDA hold time is referenced to the falling edge of SCL. Load capacitance
on SDA and SCL is 400 pF.
Figure 16. I2C Timing Diagram
SCL
SDA
Data Byte
Start Condition
Stop Condition
A
C
K
78
9
456
1
2
3
Start Condition
458
457
460
459
451
452
453
SCL
SDA
Data Byte
Start Condition
Because
of
an
order
from
the
United
States
International
Trade
Commission,
BGA-packaged
product
lines
and
part
numbers
indicated
here
currently
are
not
available
from
Freescale
for
import
or
sale
in
the
United
States
prior
to
September
2010:
MSC7118VF1200,
MSC7118VM1200,
MSC711XADS
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PDF描述
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