參數(shù)資料
型號(hào)： MPC566MZP56
廠(chǎng)商： FREESCALE SEMICONDUCTOR INC
元件分類(lèi)： 微控制器/微處理器
英文描述： 32-BIT, FLASH, 56 MHz, RISC MICROCONTROLLER, PBGA388
封裝： 27 X 27 MM, 1 MM PITCH, PLASTIC, MO-151AAL-1, BGA-388
文件頁(yè)數(shù)： 455/1387頁(yè)
文件大?。?/td> 18462K
代理商： MPC566MZP56
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MOTOROLA
Chapter 3. Central Processing Unit
3-7
Levels of the MPC500 Architecture
3.4.4
Floating-Point Unit (FPU)
The FPU contains a double-precision multiply array, the floating-point status and control
register (FPSCR), and the FPRs. The multiply-add array allows the MPC565/MPC566 to
efficiently implement floating-point operations such as multiply, multiply-add, and divide.
The MPC565/MPC566 depends on a software envelope to fully implement the IEEE
floating-point specification. Overflows, underflows, NaNs (not a number), and
denormalized numbers cause floating-point assist exceptions that invoke a software routine
to deliver (with hardware assistance) the correct IEEE result.
To accelerate time-critical operations and make them more deterministic, the
MPC565/MPC566 provides a mode of operation that avoids invoking the software
envelope and attempts to deliver results in hardware that are adequate for most applications,
if not in strict compliance with IEEE standards. In this mode, denormalized numbers,
NaNs, and IEEE invalid operations are legitimate, returning default results rather than
causing floating-point assist exceptions.
3.5
Levels of the MPC500 Architecture
The MPC500 architecture consists of three levels. Adherence to the MPC500 architecture
can be measured in terms of which of the following levels of the architecture are
implemented:
User instruction set architecture (UISA) — defines the base user-level instruction
set, user-level registers, data types, floating-point exception model, memory models
for a uniprocessor environment, and programming model for a uniprocessor
environment.
Virtual environment architecture (VEA) — describes the memory model for a
multiprocessor environment, and describes other aspects of virtual environments.
Implementations that conform to the VEA also adhere to the UISA, but may not
necessarily adhere to the OEA.
Operating environment architecture (OEA) — defines the memory-management
model, supervisor-level registers, synchronization requirements, and the exception
model. Implementations that conform to the OEA also adhere to the UISA and the
VEA.
3.6
RCPU Programming Model
The MPC500 architecture defines register-to-register operations for most computational
instructions. Source operands for these instructions are accessed from the registers or are
embedded in the instruction opcode. The three-register instruction format allows
specification of a target register distinct from the two source operands. Load and store
instructions transfer data between memory and on-chip registers.
相關(guān)PDF資料
PDF描述
MPC566CZP40 32-BIT, FLASH, 40 MHz, RISC MICROCONTROLLER, PBGA388
MPC565CVR40 32-BIT, FLASH, 40 MHz, RISC MICROCONTROLLER, PBGA388
MPC565MZP56R2 32-BIT, FLASH, 56 MHz, RISC MICROCONTROLLER, PBGA388
MPC565CVR56 32-BIT, FLASH, 56 MHz, RISC MICROCONTROLLER, PBGA388
MPC60333 32-BIT, 33.33 MHz, RISC PROCESSOR, CQFP240
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
MPC566MZP56 制造商:Freescale Semiconductor 功能描述:32-BIT MICROCONTROLLER IC POWER 5xx 56
MPC5673F 制造商:FREESCALE 制造商全稱(chēng):Freescale Semiconductor, Inc 功能描述:MPC5674F Microcontroller Data Sheet
MPC5673K 制造商:FREESCALE 制造商全稱(chēng):Freescale Semiconductor, Inc 功能描述:Microcontroller is a 32-bit embedded controller designed for advanced
MPC5674ADAT516 制造商:Freescale Semiconductor 功能描述:ADAPTER BOARD FOR MPC567 - Boxed Product (Development Kits)
MPC5674F 制造商:FREESCALE 制造商全稱(chēng):Freescale Semiconductor, Inc 功能描述:MPC5674F Microcontroller Data Sheet
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