參數(shù)資料
型號: MN103SA7D
廠商: PANASONIC CORP
元件分類: 微控制器/微處理器
英文描述: 32-BIT, MROM, MICROCONTROLLER, PQFP80
封裝: 14 X 14 MM, LEAD FREE, PLASTIC, LQFP-80
文件頁數(shù): 54/236頁
文件大?。?/td> 3095K
代理商: MN103SA7D
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Chapter 6
ROM Correction
ROM Correction Operation
VI - 11
6.3
ROM Correction Operation
ROM correction is designed to supply the microcontroller core (CPU, DMAC) with corrected data by replacing
part of data - data read from internal ROM as a result of access by the microcontroller core (CPU, DMAC) - with
the correction data stored in a ROM correction data register, thus allowing temporary correction of programs and
data stored in internal ROM.
6.3.1
ROM Correction Operation
■ ROM Correction Operation
Whether internal ROM access is made within the address range subject to correction (8 bytes or less from the
ROM correction address RCnAD) is detected by comparison between the address at which the microcontroller
core accesses internal ROM and the ROM correction address specified in the ROM correction address register
(RCRnAR). In the event of detection of access to an address subject to ROM correction, the data read from the
ROM is replaced with the correction data set in a ROM correction data register (RCRnDR). This ROM correction
function comes equipped with 4 channels, each of which can correct 8 bytes of data from a desired address in the
internal ROM. Each channel has a ROM correction address register (RCRnAR) and ROM correction data register
(RCRnDR) respectively to store correction address and correction data.
Figure:6.3.1 ROM Correction Operation
NG instruction
RCRnAR
ROM
Instruction
Correction address
RCRnDR
Correction instruction
Instruction
NG instruction
Instruction
Correction instruction
相關(guān)PDF資料
PDF描述
MN10SA7G 32-BIT, MROM, 60 MHz, MICROCONTROLLER, PQFP80
MN195007 16-BIT, 24.576 MHz, OTHER DSP, PQFP100
MN5523A SPECIALTY MICROPROCESSOR CIRCUIT, CBGA28
MPC107APX66L0 MULTIFUNCTION PERIPHERAL, PPGA503
MPC107APX100L0 MULTIFUNCTION PERIPHERAL, PPGA503
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參數(shù)描述
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