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參數(shù)資料
| 型號： | MN103SA7D |
| 廠商： | PANASONIC CORP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, MROM, MICROCONTROLLER, PQFP80 |
| 封裝： | 14 X 14 MM, LEAD FREE, PLASTIC, LQFP-80 |
| 文件頁數(shù)： | 188/236頁 |
| 文件大?。?/td> | 3095K |
| 代理商： | MN103SA7D |
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Chapter 2
CPU Basics
Programming Model
II - 7
■
Processor Status Word (16-bit x 1)
This register indicates the CPU status, and stores flags for operation results and interrupt mask level, etc.
Table:2.3.1 Processor Status Word
bp
15
14
13
12
11
10
987
65432
10
Flag
-
S1
S0
IE
IM2
IM1
IM0
-
V
C
N
Z
At reset
00000
0000
00000
00
Access
R
R/W R/W R/W R/W R/W R/W
R
R/W R/W R/W R/W
bp
Flag
Description
Set condition
15-14
-
13-12
S1
S0
Software bit
These are the software control bits for the operating system
(OS). These bits cannot be used by general user programs.
11
IE
Interrupt enable
0: disabled
1: enabled
This flag permits and accepts all interrupts except reset and
non-maskable interrupts. When the CPU accepts an interrupt
request, the IE will be cleared to 0. Therefore, IE flag must be
set to “1”, if nested interrupts need to be accepted in the inter-
rupt processing program.
10-8
IM2
IM1
IM0
Interrupt mask level
The three bits defines the mask level from level 0 (000) to level
7 (111), with level 0 being the highest mask level. The CPU
accepts only those interrupt requests of a level higher than the
mask level indicated here. When an interrupt is accepted, the
IM flag is set to the priority level of that interrupt. Until the pro-
cessing of the accepted interrupt is completed, the CPU does
not accept interrupts with the same interrupt level or lower.
7-4
-
3
V
Overflow flag
0: When an overflow does not occurs in a signed value in the
course of executing an operation.
1: When an overflow occurs in a signed value in the
course of executing an operation.
2
C
Carry flag
0: When a carry or a borrow from the most significant bit
(MSB) did not occur as a result of computation.
1: When a carry or a borrow from the most significant bit
(MSB) occured as a result of computation.
1
N
Negative flag
0: When the most significant bit (MSB) is "0" as a result of
computation.
1: When the most significant bit (MSB) is “1” as a result of
computation.
0
Z
Zero flag
0: Operation result is not “0”.
1: Operation result is “0”.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MN10SA7G | 32-BIT, MROM, 60 MHz, MICROCONTROLLER, PQFP80 |
| MN195007 | 16-BIT, 24.576 MHz, OTHER DSP, PQFP100 |
| MN5523A | SPECIALTY MICROPROCESSOR CIRCUIT, CBGA28 |
| MPC107APX66L0 | MULTIFUNCTION PERIPHERAL, PPGA503 |
| MPC107APX100L0 | MULTIFUNCTION PERIPHERAL, PPGA503 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MN103SB9N | 制造商:PANASONIC 制造商全稱:Panasonic Semiconductor 功能描述:MN103SB9N |
| MN103SF65GAL | 制造商:PANASONIC 制造商全稱:Panasonic Semiconductor 功能描述:5V single power supply (regulator) |
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