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參數(shù)資料
| 型號： | MCIMX281AVM4B |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, 454 MHz, RISC PROCESSOR, PBGA289 |
| 封裝： | 14 X 14 MM, 0.80 MM PITCH, ROHS COMPLIANT, PLASTIC, MAPBGA-289 |
| 文件頁數(shù)： | 30/72頁 |
| 文件大小： | 915K |
| 代理商： | MCIMX281AVM4B |
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i.MX28 Applications Processors Data Sheet for Automotive Products, Rev. 1
36
Freescale Semiconductor
3.5.4.1.4
MII Serial Management Channel Timing (ENET0_MDIO and ENET0_MDC)
The MDC frequency is designed to be equal to or less than 2.5 MHz to be compatible with the IEEE 802.3
MII specification. However the ENET can function correctly with a maximum MDC frequency of
15 MHz.
shown in the figure.
Figure 12. MII Serial Management Channel Timing Diagram
3.5.4.2
RMII Mode Timing
In RMII mode, ENET_CLK is used as the REF_CLK, which is a 50 MHz ± 50 ppm continuous reference
clock. ENET0_RX_DV is used as the CRS_DV in RMII. Other signals under RMII mode include
ENET0_TX_EN, ENET0_TXD[1:0], ENET0_RXD[1:0] and ENET0_RX_ER.
Table 42. MII Serial Management Channel Timing
ID
Characteristic
Min.
Max.
Unit
M10
ENET0_MDC falling edge to ENET0_MDIO output invalid (min.
propagation delay)
0—
ns
M11
ENET0_MDC falling edge to ENET0_MDIO output valid (max.
propagation delay)
—5
ns
M12
ENET0_MDIO (input) to ENET0_MDC rising edge setup
18
—
ns
M13
ENET0_MDIO (input) to ENET0_MDC rising edge hold
0
—
ns
M14
ENET0_MDC pulse width high
40%
60%
ENET0_MDC period
M15
ENET0_MDC pulse width low
40%
60%
ENET0_MDC period
ENET0_MDC (output)
ENET0_MDIO (output)
M14
M15
M10
M11
M12
M13
ENET0_MDIO (input)
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| MCIMX285AJM4A | 制造商:Freescale Semiconductor 功能描述:CATSKILLS REV 1.1 - Bulk |
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