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參數資料
| 型號： | MC9328MXLDVP20R2 |
| 廠商： | Freescale Semiconductor |
| 文件頁數： | 64/90頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MCU I.MX 200MHZ 225-MAPBGA |
| 標準包裝： | 1,000 |
| 系列： | i.MXL |
| 核心處理器： | ARM9 |
| 芯體尺寸： | 32-位 |
| 速度： | 200MHz |
| 連通性： | EBI/EMI，I²C，MMC/SD，SPI，SSI，UART/USART，USB |
| 外圍設備： | DMA，I²S，LCD，POR，PWM，WDT |
| 輸入/輸出數： | 97 |
| 程序存儲器類型： | ROMless |
| 電壓 - 電源 (Vcc/Vdd)： | 1.7 V ~ 3.3 V |
| 振蕩器型： | 外部 |
| 工作溫度： | -30°C ~ 70°C |
| 封裝/外殼： | 225-LFBGA |
| 包裝： | 帶卷 (TR) |
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Functional Description and Application Information
MC9328MXL Technical Data, Rev. 8
Freescale Semiconductor
67
4.9
Pulse-Width Modulator
The PWM can be programmed to select one of two clock signals as its source frequency. The selected
clock signal is passed through a divider and a prescaler before being input to the counter. The output is
available at the pulse-width modulator output (PWMO) external pin. Its timing diagram is shown in
Figure 51. PWM Output Timing Diagram
12
MS_SDIO output delay time1,2
–3
ns
13
MS_SDIO input setup time for MS_SCLKO rising edge (RED bit = 0)3
18
–
ns
14
MS_SDIO input hold time for MS_SCLKO rising edge (RED bit = 0)3
0–
ns
15
MS_SDIO input setup time for MS_SCLKO falling edge (RED bit = 1)4
23
–
ns
16
MS_SDIO input hold time for MS_SCLKO falling edge (RED bit = 1)4
0–
ns
1 Loading capacitor condition is less than or equal to 30pF.
2 An external resistor (100 ~ 200 ohm) should be inserted in series to provide current control on the MS_SDIO pin,
because of a possibility of signal conflict between the MS_SDIO pin and Memory Stick SDIO pin when the pin
direction changes.
3 If the MSC2[RED] bit = 0, MSHC samples MS_SDIO input data at MS_SCLKO rising edge.
4 If the MSC2[RED] bit = 1, MSHC samples MS_SDIO input data at MS_SCLKO falling edge.
Table 26. PWM Output Timing Parameter Table
Ref No.
Parameter
1.8 ± 0.1 V
3.0 ± 0.3 V
Unit
Minimum
Maximum
Minimum
Maximum
1
System CLK frequency1
0870
100
MHz
2a
Clock high time1
3.3
–
5/10
–
ns
2b
Clock low time1
7.5
–
5/10
–
ns
3a
Clock fall time1
–5
–
5/10
ns
Table 25. MSHC Signal Timing Parameter Table (Continued)
Ref
No.
Parameter
3.0 ± 0.3 V
Unit
Minimum
Maximum
System Clock
2a
1
PWM Output
3b
2b
3a
4b
4a
相關PDF資料 |
PDF描述 |
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參數描述 |
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