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參數(shù)資料
| 型號： | MC68HC11D0CFNE3R |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 5/124頁 |
| 文件大?。?/td> | 0K |
| 描述： | MCU 8-BIT 192 RAM 3MHZ 44-PLCC |
| 標準包裝： | 450 |
| 系列： | HC11 |
| 核心處理器： | HC11 |
| 芯體尺寸： | 8-位 |
| 速度： | 3MHz |
| 連通性： | SCI，SPI |
| 外圍設(shè)備： | POR，WDT |
| 輸入/輸出數(shù)： | 26 |
| 程序存儲器類型： | ROMless |
| RAM 容量： | 192 x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 4.5 V ~ 5.5 V |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 44-LCC（J 形引線） |
| 包裝： | 帶卷 (TR) |
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TIMING SYSTEM
9-16
TECHNICAL DATA
Figure 9-3 Pulse Accumulator
Pulse accumulator control bits are also located within two timer registers, TMSK2 and
TFLG2, as described in the following paragraphs.
Table 9-3 Pulse Accumulator Timing
Common XTAL Frequencies
Selected Crystal
4.0 MHz
8.0 MHz
12.0 MHz
CPU Clock
(E)
1.0 MHz
2.0 MHz
3.0 MHz
Cycle Time
(1/E)
1000 ns
500 ns
333 ns
Pulse Accumulator (in Gated Mode)
(E/26)
(E/214)
1 count -
overflow -
64.0 s
16.384 ms
32.0 s
8.192 ms
21.33 s
5.461 ms
PACNT
8-BIT COUNTER
2:1
MUX
PA7/
ENABLE
OVERFLOW
1
2
INTERRUPT
REQUESTS
INTERNAL
DATA BUS
INPUT BUFFER
&
EDGE DETECTION
PACTL
TFLG2
TMSK2
PA
O
VI
PA
II
DDRA7
PAEN
PAM
O
D
PEDG
E
PA
O
VF
PA
IF
11 PULSE ACC BLOCK
OUTPUT
BUFFER
PAI EDGE
PAEN
E ÷ 64 CLOCK
(FROM MAIN TIMER)
PAI/OC1
FROM
MAIN TIMER
OC1
DISABLE
FLAG SETTING
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MC68HC11D0CFNE2R | MCU 8-BIT 192 RAM 2MHZ 44-PLCC |
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| MC68HC11D0CFBE3R | MCU 8-BIT 192 RAM 3MHZ 44-QFP |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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