參數資料
型號: MC68HC08JL3H
廠商: 飛思卡爾半導體(中國)有限公司
英文描述: Microcontrollers
中文描述: 微控制器
文件頁數: 167/198頁
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代理商: MC68HC08JL3H
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MC68H(R)C08JL3
Rev. 4.1
Technical Data
Freescale Semiconductor
167
15.5 COP Control Register
The COP control register is located at address $FFFF and overlaps the
reset vector. Writing any value to $FFFF clears the COP counter and
starts a new timeout period. Reading location $FFFF returns the low
byte of the reset vector.
15.6 Interrupts
The COP does not generate CPU interrupt requests.
15.7 Monitor Mode
The COP is disabled in monitor mode when V
DD
+ V
HI
is present on the
IRQ1 pin or on the RST pin.
15.8 Low-Power Modes
The WAIT and STOP instructions put the MCU in low-power
consumption standby modes.
15.8.1 Wait Mode
The COP continues to operate during wait mode. To prevent a COP
reset during wait mode, periodically clear the COP counter in a CPU
interrupt routine.
Address:
$FFFF
Bit 7
6
5
4
3
2
1
Bit 0
Read:
Low byte of reset vector
Write:
Clear COP counter
Reset:
Unaffected by reset
Figure 15-3. COP Control Register (COPCTL)
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PDF描述
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參數描述
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