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參數資料
| 型號： | MC68HC08AZ24 |
| 廠商： | Motorola, Inc. |
| 英文描述： | HCMOS Microcontroller Unit |
| 中文描述： | HCMOS微控制器 |
| 文件頁數： | 109/527頁 |
| 文件大?。?/td> | 1312K |
| 代理商： | MC68HC08AZ24 |
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Clock Generator Module (CGM)
MC68HC08AZ32
108
Clock Generator Module (CGM)
MOTOROLA
NOTE:
To prevent noise problems, C
F
should be placed as close to the
CGMXFC pin as possible, with minimum routing distances and no
routing of other signals across the C
F
connection.
PLL analog power
pin (V
DDA
)
V
DDA
is a power pin used by the analog portions of the PLL. The pin
should be connected to the same voltage potential as the V
DD
pin.
NOTE:
Route V
DDA
carefully for maximum noise immunity and place bypass
capacitors as close as possible to the package.
Oscillator enable
signal (SIMOSCEN)
The SIMOSCEN signal comes from the system integration module (SIM)
and enables the oscillator and PLL.
Crystal output
frequency signal
(CGMXCLK)
CGMXCLK is the crystal oscillator output signal. It runs at the full speed
of the crystal (f
XCLK
) and is generated directly from the crystal oscillator
circuit.
Figure 1
shows only the logical relation of CGMXCLK to OSC1
and OSC2 and may not represent the actual circuitry. The duty cycle of
CGMXCLK is unknown and may depend on the crystal and other
external factors. Also, the frequency and amplitude of CGMXCLK can be
unstable at start-up.
CGM base clock
output (CGMOUT)
CGMOUT is the clock output of the CGM. This signal goes to the SIM,
which generates the MCU clocks. CGMOUT is a 50% duty cycle clock
running at twice the bus frequency. CGMOUT is software programmable
to be either the oscillator output (CGMXCLK) divided by two or the VCO
clock (CGMVCLK) divided by two.
CGM CPU interrupt
(CGMINT)
CGMINT is the interrupt signal generated by the PLL lock detector.
14-cgm
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PDF描述 |
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| MC68HC08AZ32 | 8-Bit Microcontroller Units (MCU).(8位微控制器) |
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參數描述 |
|---|---|
| MC68HC08AZ32 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Advance Information |
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