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參數(shù)資料
| 型號： | MC68HC05L25PB |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PQFP52 |
| 封裝： | TQFP-52 |
| 文件頁數(shù)： | 51/212頁 |
| 文件大?。?/td> | 2286K |
| 代理商： | MC68HC05L25PB |
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LCD Driver
Technical Data
MC68HC05L25 — Rev. 3.0
144
LCD Driver
MOTOROLA
11.4 Functional Description
The following paragraphs provide a functional description of the LCD
driver. See Figure 11-15 for a simplified schematic of the LCD system.
11.4.1 LCD Control Register
LCDE — LCD Enable
Setting this bit enables the LCD waveforms to appear on the pins.
Reset clears this bit.
1 = LCD drivers are operational. Each FP and BP driver outputs the
driver waveform specified by the data latch.
0 = LCD drivers are halted. All FP and BP drivers have the same
electric potential as VDD. RLCDs are disconnected to reduce
DC current.
PBEH — Port B Enable High Nibble
This bit enables the port B I/O bits 4–7 that are multiplexed with
frontplane drivers 20–17. Reset clears this bit.
0 = PB4–PB7/FP20–FP17 pins function as port B bits 4–7.
0 = PB4–PB7/FP20–FP17 pins function as LCD frontplane drivers
20–17.
DUTY — Duty Cycle Select
This bit selects the duty cycle of the LCD waveforms between 1/3 duty
and 1/4 duty and selects either BP3 or FP0 for the muxed pin. Reset
clears this bit.
1 = 1/3 duty cycle is selected and BP3/FP0 pin functions as FP0.
0 = 1/4 duty cycle is selected and BP3/FP0 pin functions as BP3.
Address:
$0020
Bit 7
6
54321
Bit 0
Read:
LCDE
PBEH
DUTY
PBEL
00
FC
LC
Write:
Reset:
00
000000
= Unimplemented
Figure 11-2. LCD Control Register
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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