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參數(shù)資料
| 型號(hào)： | MC68HC05L25PB |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PQFP52 |
| 封裝： | TQFP-52 |
| 文件頁數(shù)： | 161/212頁 |
| 文件大小： | 2286K |
| 代理商： | MC68HC05L25PB |
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Central Processor Unit (CPU) Core
Technical Data
MC68HC05L25 — Rev. 3.0
52
Central Processor Unit (CPU) Core
MOTOROLA
4.3.5 Condition Code Register
The condition code register shown in Figure 4-1 is a 5-bit register in
which four bits are used to indicate the results of the instruction just
executed. The fifth bit is the interrupt mask. These bits can be tested
individually by a program, and specific actions can be taken as a result
of their state. The condition code register should be thought of as having
three additional upper bits that are always 1s. Only the interrupt mask is
affected by a reset of the device. The following paragraphs explain the
functions of the lower five bits of the condition code register.
Half-Carry Bit (H Bit)
When the H bit is set, a carry has occurred between bits 3 and 4 of
the accumulator during the last ADD or ADC (add with carry)
operation. The half-carry bit is required for binary-coded decimal
(BCD) arithmetic operations.
Interrupt Mask (I Bit)
When the I bit is set, the internal and external interrupts are disabled.
Interrupts are enabled when the interrupt mask is cleared. When an
interrupt occurs, the interrupt mask is set automatically after the CPU
registers are saved on the stack, but before the interrupt vector is
fetched. If an interrupt request occurs while the interrupt mask is set,
the interrupt request is latched. Normally, the interrupt is processed
as soon as the interrupt mask is cleared.
A return from interrupt (RTI) instruction pulls the CPU registers from
the stack, restoring the interrupt mask to its state before the interrupt
was encountered. After any reset, the interrupt mask is set and can
be cleared only by the clear I bit (CLI), STOP, or WAIT instructions.
Negative Bit (N Bit)
The N bit is set when the result of the last arithmetic operation, logical
operation, or data manipulation was negative. (Bit 7 of the result was
a logical 1.)
The negative bit can also be used to check an often-tested flag by
assigning the flag to bit 7 of a register or memory location. Loading
the accumulator with the contents of that register or location then sets
or clears the negative bit according to the state of the flag.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| MC68HC05L2B | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:High-density complementary metal oxide semiconductor (HCMOS) microcontroller unit |
| MC68HC05L2CB | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:High-density complementary metal oxide semiconductor (HCMOS) microcontroller unit |
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