參數(shù)資料
型號: MC68HC05L25PB
廠商: MOTOROLA INC
元件分類: 微控制器/微處理器
英文描述: 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PQFP52
封裝: TQFP-52
文件頁數(shù): 165/212頁
文件大?。?/td> 2286K
代理商: MC68HC05L25PB
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Resets
Technical Data
MC68HC05L25 Rev. 3.0
56
Resets
MOTOROLA
5.3 External Reset (RESET)
The RESET pin is the only external source of a reset. This pin is
connected to a Schmitt trigger input gate to provide an upper and lower
threshold voltage separated by a minimum amount of hysteresis. This
external reset occurs whenever the RESET pin is pulled below the lower
threshold and remains in reset until the RESET pin rises above the upper
threshold. This active low input will generate the RST signal and reset
the CPU and peripherals. Termination of the external RESET input or
the internal COP watchdog reset are the only reset sources that can alter
the operating mode of the MCU.
NOTE:
Activation of the RST signal generally is referred to as reset of the
device, unless otherwise specified.
5.4 Internal Resets
The two internally generated resets are the initial power-on delay
function and the COP watchdog timer reset. Termination of the external
RESET input or the internal COP watchdog timer are the only reset
sources that can alter the operating mode of the MCU. The other internal
resets will not have any effect on the mode of operation when their reset
state ends.
5.4.1 Power-On Delay (POD)
The internal POD is generated on power-up to allow the clock oscillator
to stabilize. The POD is strictly for power turn-on conditions and is not
able to detect a drop in the power supply voltage (brown-out). There is
an oscillator stabilization delay of between 8,064 and 8,192 internal
processor bus clock cycles (PH2) after the oscillator becomes active.
The power-on reset (POR) will generate the RST signal which will reset
the CPU. If any other reset function is active at the end of this 8,064- to
8,192-cycle delay, the RST signal will remain in the reset condition until
the other reset condition(s) end.
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