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參數(shù)資料
| 型號： | MC68HC05L25PB |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PQFP52 |
| 封裝： | TQFP-52 |
| 文件頁數(shù)： | 40/212頁 |
| 文件大?。?/td> | 2286K |
| 代理商： | MC68HC05L25PB |
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Serial Peripheral Interface
Technical Data
MC68HC05L25 — Rev. 3.0
134
Serial Peripheral Interface
MOTOROLA
10.5 Functional Description
A block diagram of the SPI module is shown in Figure 10-1. In the SPI,
if the SPE bit (SPI enable) of SPCR is set, bits 0, 1, and 2 of port C will
be connected. During this time, bit 0 is used as the SCK (serial clock),
bit 1 as the SDO (serial data out), and bit 2 will become SDI. When SPE
is a logic zero, SPI system is disabled.
In master mode (MSTR = 1), SCK becomes an output. When the CPU
writes data to SPDR, start trigger will be applied from the control logic to
the clock generator. The clock generator divides the system clock of the
CPU (by 2 or 16) to generate the serial clock which is then output to the
SCK pin. This clock is also used in the 3-bit clock counter and 8-bit shift
register (SPDR).
In slave mode (MSTR = 0), SCK becomes an input, and the external
serial clock is used. Therefore, the internal clock generator will not
generate the serial clock. After detecting the external clock, the clock will
be used by the 3-bit clock counter and the 8-bit shift register (SPDR)
located in the clock generator. The SCK is used to latch incoming data.
In either master or slave mode, the SPIF flag is set after the end of the
transmission and if the SPIE bit in the SPCR is set, the interrupt request
is sent to the CPU. This interrupt request is accepted when the I mask
bit of condition code register (CCR) is a logic zero and is inhibited when
the bit is a logic one or until the mask is released. Also, if the SPIE bit is
cleared, the interrupt request will not be accepted by the CPU.
To clear the SPIF while it is still set, the SPDR must be read or written
after accessing SPSR.
Regardless of the master/slave I/O conditions, the DCOL bit of SPSR
will be set when SPDR is accessed while the shift register is operating
and while SPSR is not being accessed with SPIF set. DCOL is used to
indicate that the data is not being properly read or written into SPDR.
To clear the DCOL flag while it is still set, the SPDR must be read or
written after accessing SPSR.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MC68HC05L2CB | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PDIP42 |
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| MC68HC05L6FN | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PQCC68 |
| MC68HC05L7FT1 | 8-BIT, MROM, 2.45 MHz, MICROCONTROLLER, PQFP12 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MC68HC05L28 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:High-density complementary metal oxide semiconductor (HCMOS) microcontroller unit |
| MC68HC05L28B | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:Flexible general-purpose microcomputer |
| MC68HC05L2B | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:High-density complementary metal oxide semiconductor (HCMOS) microcontroller unit |
| MC68HC05L2CB | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:High-density complementary metal oxide semiconductor (HCMOS) microcontroller unit |
| MC68HC05L6 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:8-Bit Microcomputer with Liquid Crystal Driver Circuitry |
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