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參數(shù)資料
| 型號： | MC68HC05F4CDW |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 1.789 MHz, MICROCONTROLLER, PDSO28 |
| 封裝： | SOIC-28 |
| 文件頁數(shù)： | 82/130頁 |
| 文件大小： | 10504K |
| 代理商： | MC68HC05F4CDW |
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MC68HC05F4
6-5
16-BIT PROGRAMMABLE TIMER
6
IC1IE — Input capture 1 interrupt enable
If this bit is set, a timer interrupt is enabled whenever the IC1F status ag (in the timer status
register) is set.
1 (set)
–
Interrupt enabled.
0 (clear) –
Interrupt disabled.
IC2IE — Input capture 2 interrupt enable
If this bit is set, a timer interrupt is enabled whenever the IC2F status ag (in the timer status
register) is set.
1 (set)
–
Interrupt enabled.
0 (clear) –
Interrupt disabled.
OC1IE — Output compare 1 interrupt enable
If this bit is set, a timer interrupt is enabled whenever the OC1F status ag (in the timer status
register) is set.
1 (set)
–
Interrupt enabled.
0 (clear) –
Interrupt disabled.
TOIE — Timer overow interrupt enable
If this bit is set, a timer interrupt is enabled whenever the TOF status ag (in the timer status
register) is set.
1 (set)
–
Interrupt enabled.
0 (clear) –
Interrupt disabled.
CO1E — Timer compare 1 output enable
If this bit is set, the output from timer output compare 1 is enabled.
1 (set)
–
Output compare 1 enabled.
0 (clear) –
Output compare 1 disabled.
IEDG1 — Input edge 1
When IEDG1 is set, a positive-going edge on the TCAP1 pin will trigger a transfer of the
free-running counter value to the input capture register 1. When clear, a negative-going edge
triggers the transfer.
1 (set)
–
TCAP1 is positive-going edge sensitive.
0 (clear) –
TCAP1 is negative-going edge sensitive.
TPG
51
05F4Book Page 5 Tuesday, August 5, 1997 1:10 pm
F
re
e
sc
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to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
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