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參數(shù)資料
| 型號： | MC68302CFC20 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | Integrated Multiprotocol Processor User’s Manual |
| 中文描述： | RISC PROCESSOR, PQFP132 |
| 封裝： | PLASTIC, QFP-132 |
| 文件頁數(shù)： | 431/480頁 |
| 文件大?。?/td> | 1815K |
| 代理商： | MC68302CFC20 |
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SCC Programming Reference
MOTOROLA
MC68360 USER’S MANUAL
E-9
RXB—Rx Buffer
0 = No interrupt
1 = A buffer that was not a complete frame was received on the HDLC channel (set
only if the I bit in the Rx buffer descriptor is set).
E.1.1.2.5 HDLC Mask Register (SCCM).
(SCC1), $89A (SCC2), and $8AA (SCC3) on D15-D8 of a 16-bit data bus. The SCCM is
used to enable and disable interrupt events reported by the SCCE. The mask bits corre-
spond to the interrupt event bit shown in the SCCE. A bit should be set to one to enable the
corresponding interrupt in the SCCE.
This 8-bit register is located at offset $88A
E.1.1.2.6 HDLC Status Register (SCCS).
(SCC1), $89C (SCC2), and $8AC (SCC3) on D15-D8 of a 16-bit data bus. The SCCS reg-
ister reflects the current status of the RXD, CD, and CTS lines as seen by the SCC.
This 8-bit register is located at offset $88C
ID—Idle Status on the Receiver Line (valid only when the ENR bit is set and the receive
clock is running)
0 = Receiver line is not idling.
1 = Either CD is not asserted or the receiver line is idling while CD is asserted.
CD—Carrier Detect Status Changed (valid only when the ENR bit is set and the receive
clock is running)
0 = CD is asserted.
1 = CD is not asserted.
CTS—Clear-To-Send Status Changed (valid only when the ENT bit is set and the transmit
clock is running)
0 = CTS is asserted.
1 = CTS is not asserted.
E.1.1.3 GENERAL AND HDLC PROTOCOL-SPECIFIC PARAMETER RAM.
has 32 words of parameter RAM used to configure receive and transmit operation, store
temporary parameters for the CP, and maintain counters. The first 14 words are general
parameters, which are the same for each protocol. The last 18 words are specific to the pro-
tocol selected. The following sections discuss the parameters that the user must initialize to
configure the HDLC operation.
Each SCC
E.1.1.3.1 RFCR/TFCR—Rx Function Code/Tx Function Code.
contains the function codes of the receive data buffers and transmit data buffers. The user
must initialize the function codes (FC2-FC0) to a value less than 7.
This 16-bit parameter
7
6
5
4
3
2
1
0
CTS
CD
IDL
TXE
RXF
BSY
TXB
RXB
7
—
6
—
5
—
4
—
3
—
2
ID
1
0
CD
CTS
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MC68302CRC16 | Integrated Multiprotocol Processor User’s Manual |
| MC68302CRC20 | Integrated Multiprotocol Processor User’s Manual |
| MC68302RC16 | Integrated Multiprotocol Processor User’s Manual |
| MC6802 | Microprocessor With Clock and Oprtional RAM |
| MC68B02P | Microprocessor With Clock and Oprtional RAM |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MC68302CFC20C | 制造商:Motorola 功能描述:68302 |
| MC68302CFE16 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Communications Controller |
| MC68302CFE20 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Communications Controller |
| MC68302CPV16VC | 功能描述:IC MPU NETWORK 16MHZ 144-LQFP RoHS:否 類別:集成電路 (IC) >> 嵌入式 - 微處理器 系列:M683xx 標(biāo)準(zhǔn)包裝:2 系列:MPC8xx 處理器類型:32-位 MPC8xx PowerQUICC 特點(diǎn):- 速度:133MHz 電壓:3.3V 安裝類型:表面貼裝 封裝/外殼:357-BBGA 供應(yīng)商設(shè)備封裝:357-PBGA（25x25） 包裝:托盤 |
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