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參數(shù)資料
| 型號： | MC68302CFC20 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | Integrated Multiprotocol Processor User’s Manual |
| 中文描述： | RISC PROCESSOR, PQFP132 |
| 封裝： | PLASTIC, QFP-132 |
| 文件頁數(shù)： | 202/480頁 |
| 文件大小： | 1815K |
| 代理商： | MC68302CFC20 |
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Communications Processor (CP)
4-82
MC68302 USER’S MANUAL
MOTOROLA
IDL—IDLE Sequence Status Changed
A change in the status of the serial line was detected on the HDLC channel. The SCC sta-
tus register may be read to determine the current status.
TXE—Tx Error
An error (CTS lost or underrun) occurred on the transmitter channel.
RXF—Rx Frame
A complete frame has been received on the HDLC channel. This bit is set no sooner than
two receive clocks after receipt of the last bit of the closing flag.
BSY—Busy Condition
A frame was received and discarded due to lack of buffers.
TXB—Tx Buffer
A buffer has been transmitted on the HDLC channel. This bit is set no sooner than when
the second-to-last bit of the closing flag begins its transmission, if the buffer is the last in
the frame. Otherwise, it is set after the last byte of the buffer has been written to the trans-
mit FIFO.
RXB—Rx Buffer
A buffer has been received on the HDLC channel that was not a complete frame. This bit
will only be set if the I bit in the Tx BD was set.
4.5.12.13 HDLC Mask Register
The SCC mask register (SCCM) is referred to as the HDLC mask register when the SCC is
operating as an HDLC controller. It is an 8-bit read-write register that has the same bit for-
mats as the HDLC event register. If a bit in the HDLC mask register is a one, the correspond-
ing interrupt in the event register will be enabled. If the bit is zero, the corresponding interrupt
in the event register will be masked. This register is cleared upon reset.
4.5.13 BISYNC Controller
The byte-oriented binary synchronous communication (BISYNC) protocol was originated by
IBM for use in networking products. The three classes of BISYNC frames are transparent,
non-transparent with header, and non-transparent without header (see Figure 4-30). The
transparent mode in BISYNC allows full binary data to be transmitted, with any possible
character pattern allowed. Each class of frame starts with a standard two octet synchroni-
zation pattern and ends with a block check code (BCC). The end of text character (ETX) is
used to separate the text and BCC fields.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MC68302CRC16 | Integrated Multiprotocol Processor User’s Manual |
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| MC68302CPV16VC | 功能描述:IC MPU NETWORK 16MHZ 144-LQFP RoHS:否 類別:集成電路 (IC) >> 嵌入式 - 微處理器 系列:M683xx 標(biāo)準(zhǔn)包裝:2 系列:MPC8xx 處理器類型:32-位 MPC8xx PowerQUICC 特點(diǎn):- 速度:133MHz 電壓:3.3V 安裝類型:表面貼裝 封裝/外殼:357-BBGA 供應(yīng)商設(shè)備封裝:357-PBGA（25x25） 包裝:托盤 |
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