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參數(shù)資料
| 型號： | MC68040RC40V |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 107/442頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MICROPROCESSOR 32BIT 182-PGA |
| 標(biāo)準(zhǔn)包裝： | 10 |
| 系列： | M680x0 |
| 處理器類型： | M680x0 32-位 |
| 速度： | 40MHz |
| 電壓： | 5V |
| 安裝類型： | 通孔 |
| 封裝/外殼： | 182-BEPGA |
| 供應(yīng)商設(shè)備封裝： | 182-PGA（47.24x47.24） |
| 包裝： | 托盤 |
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MOTOROLA
M68040 USER’S MANUAL
7- 53
how the LOCKE signal can be used to end a locked sequence and to yield the bus one
bus cycle earlier than is normally possible. Figure 7-35 illustrates the state diagram of a
hypothetical external arbiter design.
BB
Λ LOCK Λ LOCKE*
STATE A
STATE B
STATE C
STATE D
BR1* V BR1
Λ
LOCK
Λ LOCKE*
BB
Λ LOCK* V BB Λ
LOCK
Λ LOCKE
BG1*, BG2
BG1, BG2*
BR2
Λ LOCK Λ LOCKE
V BR2
Λ LOCK*
BR2* V
BR2
Λ LOCK Λ LOCKE
BB*
BG1*, BG2
BG1, BG2*
BB
Λ LOCK* V BB Λ
LOCK
Λ LOCKE
BB*
BR1
Λ LOCK Λ LOCKE
V BR1
Λ LOCK*
Because this example uses two MC68040s, 1 and 2 refer to the processor and its signals.
*Indicates the signal is asserted for that device.
NOTES:
1.
2.
BB
Λ LOCK Λ LOCKE*
Figure 7-35. Dual M68040 Fairness Arbitration State Diagram
Assuming that processor 1 currently owns the bus, the external arbiter is in state A. If
processor 2 asserts BR2, then processor 1 behaves in one of three ways:
1. If processor 1 is currently in the middle of a nonlocked bus access, then the external
arbiter proceeds to state B, in which BG1 is negated and BG2 is asserted. The
external arbiter then proceeds to state C only when BB is negated, signifying the end
of the bus cycle.
2. If processor 1 is currently in the middle of a locked bus access, then the external
arbiter stays in state A until LOCKE is asserted. Once LOCKE is asserted, the
external arbiter enters state B, in which BG1 is negated and BG2 is asserted. The
external arbiter proceeds to state C once BB is negated, signifying the end of the
bus cycle.
3. If processor 1 is in one of the three boundary conditions, then the external arbiter
proceeds to state B. During state B, the external arbiter checks for the possibility of a
newly initiated locked bus access. If it detects a locked bus cycle, it returns the bus
to processor 1 by entering state A. Note that even though processor 1 recognizes
BG1 is asserted, it does not take the bus because processor 1 asserts BB whenever
the boundary condition results in processor 1 performing another bus cycle. The
external arbiter stays in state A until LOCKE is asserted, then proceeds to state B to
F
re
e
sc
a
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S
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r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| ABB108DHBD | CONN EDGECARD 216PS R/A .050 SLD |
| MC68040RC33A | IC MICROPROCESSOR 32BIT 179-PGA |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MC68040V | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:M68000-compatible, high-performance, 32-bit microprocessors |
| MC6805S2 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:8-Bit Microcomputers |
| MC6805S2CL | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:8-Bit Microcomputers |
| MC6805S2CP | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:8-Bit Microcomputers |
| MC6805S2CS | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:8-Bit Microcomputers |
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