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參數(shù)資料
| 型號(hào)： | MB91101APF |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, 50 MHz, RISC MICROCONTROLLER, PQFP100 |
| 封裝： | PLASTIC, QFP-100 |
| 文件頁(yè)數(shù)： | 88/99頁(yè) |
| 文件大?。?/td> | 935K |
| 代理商： | MB91101APF |
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MB91101/MB91101A
89
(14) UART Timing
(VCC5 = 5.0 V
±10%, VSS = AVSS = 0.0 V, TA = 0°C to +70°C)
(VCC5 = VCC3 = 2.7 V to 3.6 V, VSS = AVSS = 0.0 V, TA = 0
°C to +70°C)
tCYCP: A cycle time of peripheral system clock
Note This rating is for AC characteristics in CLK synchronous mode.
Parameter
Symbol Pin name Condition
Value
Unit
Remarks
Min
Max
Serial clock cycle time
tSCYC
—
Internal
shift clock
mode
8
× tCYCP
—ns
SCLK
↓→ SCLK ↑
tSCLCH
—4
× tCYCP –10 4 × tCYCP +10 ns
SCLK
↑→ SCLK ↓
tSCHCL
—4
× tCYCP –10 4 × tCYCP +10 ns
SCLK
↓→ SOUT delay time tSLOV
—
–80
+80
ns
Valid SIN
→ SCLK ↑
tIVSH
—
100
—
ns
SCLK
↑→ valid SIN hold
time
tSHIX
—60
—
ns
Serial clock “H” pulse width
tSHSL
—
External
shift clock
mode
4
× tCYCP
—ns
Serial clock “L” pulse width
tSLSH
—4
× tCYCP
—ns
SCLK
↓→ SOUT delay time tSLOV
——
150
ns
Valid SIN
→ SCLK ↑
tIVSH
—60
—
ns
SCLK
↑→ valid SIN hold
time
tSHIX
—60
—
ns
SCLK
SOUT
SIN
SCLK
SOUT
SIN
tSCYC
tSCLCH
tSCHCL
tSLOV
tIVSH
tSHIX
tSHSL
tSLSH
tSLOV
tIVSH
tSHIX
VOL
VOH
VIL
VIH
VOL
VOH
VIL
VIH
VOL
VOH
VIL
VIH
VIL
VIH
VIL
VIH
Internal shift clock mode
External shift clock mode
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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