參數(shù)資料
型號(hào)： MB91101APF
元件分類： 微控制器/微處理器
英文描述： 32-BIT, 50 MHz, RISC MICROCONTROLLER, PQFP100
封裝： PLASTIC, QFP-100
文件頁(yè)數(shù)： 84/99頁(yè)
文件大?。?/td> 935K
代理商： MB91101APF
MB91101/MB91101A
85
(11) Hyper DRAM Timing
(VCC5 = 5.0 V
±10%, VSS = AVSS = 0.0 V, TA = 0°C to +70°C)
(VCC5 = VCC3 = 2.7 V to 3.6 V, VSS = AVSS = 0.0 V, TA = 0
°C to +70°C)
tCYC (a cycle time of peripheral system clock): Refer to “(2) Clock Output Timing.”
Parameter
Symbol
Pin name
Condition
Value
Unit Remarks
Min
Max
RAS delay time
tCLRAH3
CLK, RAS0, RAS1
—
—6
ns
tCHRAL3
CLK, RAS0, RAS1
—
6
ns
CAS delay time
tCHCASL3
CLK, CS0H, CS0L,
CS1H, CS1L
—n/2
× tCYC
ns
tCHCASH3
CLK, CS0H, CS0L,
CS1H, CS1L
—6
ns
ROW address delay time
tCHRAV3
CLK,
A24 to A00
—15
ns
COLUMN address delay
time
tCHCAV3
CLK,
A24 to A00
—15
ns
RD delay time
tCHRL3
CLK, RD
—15
ns
tCHRH3
CLK, RD
—15
ns
tCLRL3
CLK, RD
—15
ns
DW delay time
tCHDWL3
CLK, DW0, DW1
—15
ns
tCHDWH3
CLK, DW0, DW1
—15
ns
Output data delay time
tCHDV3
CLK,
D31 to D16
—15
ns
CAS
↓→ valid data input
time
tCLDV3
CS0H, CS0L, CS1H,
CS1L, D31 to D16
—tCYC – 17
ns
CAS
↓→ data hold time
tCADH3
CS0H, CS0L, CS1H,
CS1L, D31 to D16
0—
ns
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PDF描述
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