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參數(shù)資料
| 型號(hào)： | MB90M407PF |
| 元件分類(lèi)： | 微控制器/微處理器 |
| 英文描述： | MICROCONTROLLER, PQFP100 |
| 封裝： | 14 X 20 MM, 3.35 MM HEIGHT, 0.65 MM PITCH, PLASTIC, QFP-100 |
| 文件頁(yè)數(shù)： | 54/68頁(yè) |
| 文件大小： | 1486K |
| 代理商： | MB90M407PF |
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MB90M405 Series
58
DS07-13718-3E
(4) Serial I/O
(Ta
= 40 °C to +85 °C, VDD-FIP = VCC-CPU = AVCC = 3.0 V to 3.6 V, VSS-IO = VSS-CPU = AVSS = 0 V)
Notes :
Above rating is the case of CLK synchronous mode.
CL is the load capacitor connected to the pin for testing.
tCP is the machine cycle period (unit = ns)
Parameter
Symbol
Pin Name
Condition
Value
Unit Remarks
Min
Max
Serial clock cycle time
tSCYC
SC0 to SC3
Internal shift clock
mode, output pin
load is
CL
= 80 pF + 1 TTL
8 tCP
ns
SCK
↓ → SOT delay time
tSLOV
SC0 to SC3
SO0 to SO3
80
ns
Valid SIN
→ SCK ↑
tIVSH
SC0 to SC3
SI0 to SI2
100
ns
SCK
↑ → valid SIN hold time
tSHIX
SC0 to SC3
SI0 to SI2
60
ns
Serial clock “H” pulse width
tSHSL
SC0 to SC3
External shift clock
mode, output pin
load is
CL
= 80 pF + 1 TTL
4 tCP
ns
Serial clock “L” pulse width
tSLSH
SC0 to SC3
4 tCP
ns
SCK
↓ → SOT delay time
tSLOV
SC0 to SC3
SO0 to SO3
150
ns
Valid SIN
→ SCK ↑
tIVSH
SC0 to SC3
SI0 to SI2
60
ns
SCK
↑ → valid SIN hold time
tSHIX
SC0 to SC3
SI0 to SI2
60
ns
相關(guān)PDF資料 |
PDF描述 |
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