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參數(shù)資料
| 型號： | MB90M407PF |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | MICROCONTROLLER, PQFP100 |
| 封裝： | 14 X 20 MM, 3.35 MM HEIGHT, 0.65 MM PITCH, PLASTIC, QFP-100 |
| 文件頁數(shù)： | 40/68頁 |
| 文件大?。?/td> | 1486K |
| 代理商： | MB90M407PF |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁當(dāng)前第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁
MB90M405 Series
DS07-13718-3E
45
12. Watch Clock Output
The watch clock output circuit divides the oscillator clock by means of the timebase timer, and outputs the set
division clock. Can be set to 1/32, 1/64, 1/128, or 1/256 of oscillator clock.
Watch clock output circuit
The watch clock output circuit is disabled in reset and stop modes. It is enabled in normal run modes, sleep
mode, and pseudo clock mode.
If the timebase timer is cleared while the watch clock output circuit is in use, clock output cannot be conducted
normally.
Block Diagram of Watch Clock Output Circuit
PLL_Run
Main_Run
Sleep
Pseudo Clock
STOP
Reset
Operating
State
×
X0
X1
Watch clock selection circuit
Oscillator
Selector
Timebase timer
Divide-by-two
circuit
Watch clock output
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MB90P214APF | 16-BIT, OTPROM, 16 MHz, MICROCONTROLLER, PQFP80 |
| MB90P634APF | 16-BIT, OTPROM, 16 MHz, MICROCONTROLLER, PQFP100 |
| MB90634APFV | 16-BIT, MROM, 16 MHz, MICROCONTROLLER, PQFP100 |
| MB90634APF | 16-BIT, MROM, 16 MHz, MICROCONTROLLER, PQFP100 |
| MB90P641APFV | 16-BIT, OTPROM, 17 MHz, MICROCONTROLLER, PQFP100 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| MB9100-100 | 制造商:COM/DUO 功能描述:FAN 4-6WKS |
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