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參數(shù)資料
| 型號： | MB90F372PMT-G |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-BIT, FLASH, 16 MHz, MICROCONTROLLER, PQFP144 |
| 封裝： | 0.40 MM PITCH, PLASTIC, LQFP-144 |
| 文件頁數(shù)： | 146/153頁 |
| 文件大小： | 2503K |
| 代理商： | MB90F372PMT-G |
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MB90370 Series
92
19. Parity generator
The parity generator is a simple circuit that generates odd / even parity based on the input data. It consists of a
parity generator data register (PGDR), an odd / even parity generation logic and a parity generator control status
register (PGCSR).
An 8-bit data can be loaded into PGDR, then the parity generator will generate odd / even parity based on the
input data. Either odd or even parity can be generated by setting the PGCSR.
For odd parity generation, if the number of “1”s in the PGDR is even number, then the parity bit in PGCSR will
be set to “1”, otherwise the parity bit will be set to “0”.
For even parity generation, if the number of “1”s in the PGDR is even number, then the parity bit in PGCSR will
be set to “0”, otherwise the parity bit will be set to “1”.
Table shows some examples of odd / even parity generation.
(1) Register configuration of parity generator
Input data
Parity bit (odd parity)
Parity bit (even parity)
0000 0000B
0101 0101B
1000 0000B
1010 1011B
1
0
1
15
14
13
12
11
10
9
8
Parity Generator Control Status Register
PGCSR
Bit number
R/W
0
Initial value
Read/write
PSEL
76
5
4
3
2
1
0
Parity Generator Data Register
PGDR
Bit number
Initial value
Read/write
D6
D5
D4
D3
D2
D1
D0
Address : 000018H
Address : 000019H
R
X
PRTY
D7
R/W
X
R/W
X
R/W
X
R/W
X
R/W
X
R/W
X
R/W
X
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X
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